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參數(shù)資料
| 型號： | μPD78P058FY |
| 廠商： | NEC Corp. |
| 元件分類： | 8位微控制器 |
| 英文描述： | 8 Bit Single Chip Microcontrollers |
| 中文描述： | 8位單片機微控制器 |
| 文件頁數(shù)： | 44/74頁 |
| 文件大小： | 520K |
| 代理商： | ΜPD78P058FY |
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μ
PD78P058FY
44
(v) I
2
C bus mode (SCL ... internal clock output)
Parameter
Symbol
Test Conditions
MIN.
TYP.
MAX.
Unit
SCL cycle time
t
KCY5
R = 1 k
,
V
DD
= 2.7 to 6.0 V
10
μ
s
C = 100 pF
Note
20
μ
s
SCL high-level width
t
KH5
V
DD
= 2.7 to 6.0 V
t
KCY5
– 160
ns
t
KCY5
– 190
ns
SCL low-level width
t
KL5
V
DD
= 4.5 to 6.0 V
t
KCY5
– 50
ns
t
KCY5
– 100
ns
SDA0, SDA1 setup time
t
SIK5
V
DD
= 2.7 to 6.0 V
200
ns
(to SCL
↑
)
300
ns
SDA0, SDA1 hold time (from SCL
↓
)
t
KSI5
0
ns
SDA0, SDA1
t
KSO5
V
DD
= 4.5 to 6.0 V
0
300
ns
output delay time from SCL
↓
0
500
ns
SDA0, SDA1
↓
from SCL
↑
or
t
KSB
200
ns
SDA0, SDA1
↑
from SCL
↑
SCL
↓
from
SDA0, SDA1
↓
t
SBK
400
ns
SDA0, SDA1 high-level width
t
SBH
500
ns
Note
R and C are the SCL, SDA0, and SDA1 output line load resistance and load capacitance.
(vi) I
2
C bus mode (SCL ... external clock input)
Parameter
Symbol
Test Conditions
MIN.
TYP.
MAX.
Unit
SCL cycle time
t
KCY6
1000
ns
SCL high-/low-level width
t
KH6
,
400
ns
t
KL6
SDA0, SDA1 setup time (to SCL
↑
)
t
SIK6
200
ns
SDA0, SDA1 hold time (from SCL
↓
)
t
KSI6
0
ns
SDA0, SDA1
t
KSO6
R = 1 k
,
V
DD
= 4.5 to 6.0 V
0
300
ns
output delay time from SCL
↓
C = 100 pF
Note
0
500
ns
SDA0, SDA1
↓
from SCL
↑
or
t
KSB
200
ns
SDA0, SDA1
↑
from SCL
↑
SCL
↓
from
SDA0, SDA1
↓
t
SBK
400
ns
SDA0, SDA1 high-level width
t
SBH
500
ns
SCL rise, fall time
t
R6
,
When using external device
160
ns
t
F6
expansion function
When not using external
1000
ns
device expansion function
Note
R and C are the SDA0 and SDA1 output line load resistance and load capacitance.
相關PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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