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參數(shù)資料
| 型號(hào)： | XRT79L74IB |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | 4 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC |
| 中文描述： | ATM NETWORK INTERFACE, PBGA456 |
| 封裝： | 27 X 27 MM, 1 MM PITCH, PLASTIC, BGA-456 |
| 文件頁數(shù)： | 26/70頁 |
| 文件大?。?/td> | 547K |
| 代理商： | XRT79L74IB |
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XRT79L74
REV. P1.0.0
PRELIMINARY
4 - CHANNEL DS3/E3 ATM UNI/PPP COMBO IC
24
P
IN
#
N
AME
TYPE
D
ESCRIPTION
RECEIVE SYSTEM SIDE INTERFACE PINS
M2
H23
P5
K24
RxAIS1/
RxNib1_2/
RxHDLCDat1_2
RxAIS2/
RxNib2_2/
RxHDLCDat2_2
RxAIS3/
RxNib3_2/
RxHDLCDat3_2
RxAIS4/
RxNib4_2/
RxHDLCDat4_2
O
O
O
O
Receive AIS Pattern Indicator/Receive Nibble Output Interface - Bit 2/
Receive HDLC Controller Data Bus - Bit 2 output pin:
The function of these output pins depend upon whether the XRT79L74 has
been configured to operate in the Clear-Channel Framer/Nibble-Parallel Inter-
face Mode, the High-Speed HDLC Controller Mode, or in the other modes.
Other Modes - RxAIS:
These output pins are driven "High" whenever the Receive Section of the
XRT79L74 has detected and is currently declaring an AIS (Alarm Indicator Sig-
nal) condition.
Clear-Channel Framer/Nibble-Parallel Interface Mode - RxNib_2:
If the XRT79L74 is configured to operate in the Nibble-Parallel Mode, then
these output pins will function as the bit 2 output from the Receive Nibble-Paral-
lel output interface. The Receive Payload Data Output Interface block will out-
put these signals (along with RxNibn_0, RxNibn_1, and RxNibn_3) upon the
rising edge of the RxClk output signals.
High-Speed HDLC Controller Mode - RxHDLCDat_2:
These output pins along with RxHDLCDatn_[7:3] and RxHDLCDatn_[1:0] func-
tions as the Receive HDLC Controller byte wide output data bus. The Receive
HDLC Controller will output the contents of all HDLC frames via this output data
bus, upon the rising edge of the RxHDLCClk output signals. Hence, the user’s
local terminal equipment should be designed/configured to sample this data
upon the falling edge of the RxHDLCClk output clock signals.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT8000ID | Clock Synchronizer/Adapter for Communications |
| XRT8000 | Clock Synchronizer/Adapter for Communications(用于通訊的時(shí)鐘同步設(shè)備/調(diào)整器) |
| XRT8001 | WAN Clock for T1 and E1 Systems |
| XRT8001ID | WAN Clock for T1 and E1 Systems |
| XRT8001IP | WAN Clock for T1 and E1 Systems |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT8000 | 制造商:EXAR 制造商全稱:EXAR 功能描述:Clock Synchronizer/Adapter for Communications |
| XRT8000_06 | 制造商:EXAR 制造商全稱:EXAR 功能描述:Clock Synchronizer/Adapter for Communications |
| XRT8000D | 制造商:EXAR 制造商全稱:EXAR 功能描述:CLOCK SYNCHRONIZER/ADAPTER FOR COMMUNICATIONS |
| XRT8000ES | 功能描述:鎖相環(huán) - PLL WAN CLOCK RoHS:否 制造商:Silicon Labs 類型:PLL Clock Multiplier 電路數(shù)量:1 最大輸入頻率:710 MHz 最小輸入頻率:0.002 MHz 輸出頻率范圍:0.002 MHz to 808 MHz 電源電壓-最大:3.63 V 電源電壓-最小:1.71 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:QFN-36 封裝:Tray |
| XRT8000ID | 制造商:EXAR 制造商全稱:EXAR 功能描述:Clock Synchronizer/Adapter for Communications |
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