參數(shù)資料
型號(hào)： XRT75R06IB-F
廠商： Exar Corporation
文件頁(yè)數(shù)： 55/63頁(yè)
文件大小： 0K
描述： IC LIU E3/DS3/STS-1 6CH 217BGA
標(biāo)準(zhǔn)包裝： 126
類型： 線路接口裝置（LIU）
驅(qū)動(dòng)器/接收器數(shù)： 6/6
規(guī)程： DS3，E3，STS-1
電源電壓： 3.135 V ~ 3.465 V
安裝類型： 表面貼裝
封裝/外殼： 217-BBGA
供應(yīng)商設(shè)備封裝： 217-BGA（23x23）
包裝： 托盤
á
XRT75R06
SIX CHANNEL E3/DS3/STS-1 LINE INTERFACE UNIT WITH JITTER ATTENUATOR
REV. 1.0.0
56
0x07 (ch 0)
0x17 (ch 1)
0x27 (ch 2)
0x37 (ch 3)
0x47 (ch 4)
0x57 (ch 5)
R/W
Jitter
Attenuator
D0
JA0_n
This bit along with JA1_n bit configures the Jitter
Attenuator as shown in the table below.
0
D1
JATx/Rx_n Setting this bit selects the Jitter Attenuator in the
Transmit Path. A “0” selects in the Receive Path.
0
D2
JA1_n
This bit along with the JA0_n configures the Jitter
Attenuator as shown in the table.
0
D3
PNTRST_n Setting this bit resets the FIFO pointers to their initial
state and flushes the FIFO. All existing FIFO data is
lost.
0
D4
DFLCK_n
Set this bit to “1” to disable fast locking of the PLL.
This helps to reduce the time for the PLL to lock to
incoming frequency when the Jitter Attenuator
switches to narrow band.
0
D7-D5
Reserved
TABLE 18: REGISTER MAP DESCRIPTION - CHANNEL N
ADDRESS
(HEX)
TYPE
REGISTER
NAME
BIT#
SYMBOL
DESCRIPTION
DEFAULT
VALUE
JA0_n
0
Mode
16 bit FIFO
32 bit FIFO
JA1_n
0
1
Disable Jitter
Attenuator
0
1
Disable Jitter
Attenuator
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PDF描述
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