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參數(shù)資料
| 型號： | XRT72L50IQ |
| 廠商： | EXAR CORP |
| 元件分類： | 數(shù)字傳輸電路 |
| 英文描述： | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| 中文描述： | DATACOM, FRAMER, PQFP100 |
| 封裝： | 14 X 20 MM, PLASTIC, QFP-100 |
| 文件頁數(shù)： | 67/471頁 |
| 文件大小： | 2424K |
| 代理商： | XRT72L50IQ |
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á
XRT72L50
SINGLE CHANNEL DS3/E3 FRAMER WITH HDLC CONTROLLER
REV. 1.2.1
54
Bit 4 - RxOOF (Receive Out-of-Frame) Indicator
This Read-Only bit-field indicates whether or not the Receive Section of the channel is currently declaring an
OOF condition.
If this bit-field is set to "0", then the Receive Section is currently not declaring the OOF condition.
If this bit-field is set to "1", then the Receive Section is currently declaring the OOF condition.
N
OTE
:
For more information on the OOF Declaration criteria, for DS3 applications, refer to
Section 4.3.2.2
.
Bit 3 - Reserved
Bit 2 - Framing On Parity ON/OFF Select
This Read/Write bit field allows the user to require that the Receive DS3/E3 Framer block include Parity (P-bit)
verification as a condition for declaring itself In-Frame during Frame Acquisition. This requirement will be
imposed in addition to those criteria selected via Bits 0 and 1 of this register.
This feature also imposes an additional Frame Maintenance requirement on the Receive DS3/E3 Framer block,
in addition to the requirements specified in the user's selection of Bits 0 and 1 of this register. In particular, if
this additional requirement is implemented, the Receive DS3/E3 Framer block will perform a frame search if it
detects P-bit errors in at least 2 out of 5 DS3 Frames. Writing a "1" to this bit-field imposes these additional
requirements. Whereas, writing a '0' causes the Receive DS3/E3 Framer block to waive this requirement.
N
OTE
:
For more information on Framing with Parity, refer to
Section 4.3.2.2
.
Bit 1 - F Sync Algo(rithim Select)
This Read/Write bit-field, in conjunction with Bits 0 and 2 of this register, allows the user to completely define
the Frame Maintenance Criteria of the Receive DS3/E3 Framer block. This particular bit-field allows the user
to define the Frame Maintenance Criteria as it applies to F-bits.
If the user writes a "1" to this bit-field, then the Receive DS3/E3 Framer block will declare an Out of Frame
(OOF) condition if 3 out of 16 F-Bits are in Error. If the user writes a "0" to this bit-field, then the Receive DS3/
E3 Framer block will declare an Out of Frame (OOF) condition if 6 out of 16 F-bits are in error.
N
OTE
:
For more information on the use of this bit, and the Framing Maintenance operation of the Receive DS3/E3 Framer
block, refer to
Section 4.3.2.2
.
Bit 0 - M Sync Algo(rithm Select)
This Read/Write bit-field in conjunction with Bits 1 and 2 of this register, allows the user to completely define
the Frame Maintenance Criteria of the Receive DS3/E3 Framer block. This particular bit-field allows the user
to define the Frame Maintenance criteria, as it applies to M-bits.
If the user writes a "1" to this bit-field, then the Receive DS3/E3 Framer block will declare an Out of Frame
(OOF) condition if 3 out of 4 M-bits are in error. If the user writes a "0" to this bit-field, then the Receive DS3/E3
Framer block will ignore the occurrence of M-bit errors while operating in the Frame Maintenance mode.
N
OTE
:
For more information on the use of this bit-field, and the Framing Maintenance operation of the Receive DS3/E3
Framer block, refer to
Section 4.3.2.2
.
2.3.2.9
Receive DS3 Status Register
Bit 4 - RxFERF Indicator
This Read Only bit-field indicates whether or not the Receive Section of the channel is declaring a FERF (Far-
End-Receive Failure) condition.
RxDS3 Status Register (Address = 0x11)
B
IT
7
B
IT
6
B
IT
5
B
IT
4
B
IT
3
B
IT
2
B
IT
1
B
IT
0
Reserved
RxFERF
RxAIC
RxFEBE[2:0]
RO
RO
RO
RO
RO
RO
RO
RO
0
0
0
1
0
0
0
0
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| XRT72L50 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L52IQ | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L52 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L53 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| XRT72L54 | Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XRT72L50IQ-F | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT72L50IQTR-F | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT72L52 | 制造商:EXAR 制造商全稱:EXAR 功能描述:TWO CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER |
| XRT72L52ES-PCI | 功能描述:網(wǎng)絡(luò)控制器與處理器 IC RoHS:否 制造商:Micrel 產(chǎn)品:Controller Area Network (CAN) 收發(fā)器數(shù)量: 數(shù)據(jù)速率: 電源電流（最大值）:595 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:PBGA-400 封裝:Tray |
| XRT72L52IQ | 制造商:EXAR 制造商全稱:EXAR 功能描述:TWO CHANNEL DS3/E3 FRAMER IC WITH HDLC CONTROLLER |
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