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參數(shù)資料
| 型號(hào)： | XRD54L12AIP-F |
| 廠商： | Exar Corporation |
| 文件頁(yè)數(shù)： | 13/16頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC DAC 12BIT SRL LP 8PDIP |
| 標(biāo)準(zhǔn)包裝： | 50 |
| 設(shè)置時(shí)間： | 13µs |
| 位數(shù)： | 12 |
| 數(shù)據(jù)接口： | 串行 |
| 轉(zhuǎn)換器數(shù)目： | 1 |
| 電壓電源： | 單電源 |
| 功率耗散（最大）： | 117mW |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類(lèi)型： | 通孔 |
| 封裝/外殼： | 8-DIP（0.300"，7.62mm） |
| 供應(yīng)商設(shè)備封裝： | 8-PDIP |
| 包裝： | 管件 |
| 輸出數(shù)目和類(lèi)型： | * |
| 采樣率（每秒）： | * |
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XRD54L08/L10/L12
6
Rev. 1.30
TIMING
CS
SCLK
SDIN
DOUT
tCSW
tCS1
tCSH1
tCL
tD0
tDH
tDS
tCH
tCSS
tCSH0
Figure 2. Timing Diagram
Input
Output
1111
(0000)
1000
0001
(0000)
1000
0000
(0000)
0111
1111
(0000)
0000
0001
(0000)
0000
(0000)
0V
Note:
Write 8-bit data words with four sub-LSB 0s because the DAC input latch
is 12 bits wide.
Table 1. Binary Code Table
+ 2 (VREFIN)
127
256
+ 2 (VREFIN)
129
256
+ 2 (VREFIN)
255
256
+ 2 (VREFIN)
128
256 = +
VREFIN
+ 2 (VREFIN)
1
256
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