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參數(shù)資料
| 型號(hào)： | XR17V252IM |
| 廠(chǎng)商： | Exar Corporation |
| 文件頁(yè)數(shù)： | 27/69頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC UART PCI BUS DUAL 100TQFP |
| 產(chǎn)品變化通告： | Leaded UART, V&I Obsolescence 11/Apr/2011 |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 特點(diǎn)： | * |
| 通道數(shù)： | 2，DUART |
| FIFO's： | 64 字節(jié) |
| 規(guī)程： | RS485 |
| 電源電壓： | 3.3V，5V |
| 帶自動(dòng)流量控制功能： | 是 |
| 帶IrDA 編碼器/解碼器： | 是 |
| 帶故障啟動(dòng)位檢測(cè)功能： | 是 |
| 帶調(diào)制解調(diào)器控制功能： | 是 |
| 安裝類(lèi)型： | 表面貼裝 |
| 封裝/外殼： | 100-TQFP |
| 供應(yīng)商設(shè)備封裝： | 100-TQFP（14x14） |
| 包裝： | 托盤(pán) |
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XR17V252
33
REV. 1.0.2
66 MHZ PCI BUS DUAL UART WITH POWER MANAGEMENT SUPPORT
4.4
Internal Loopback
Each UART channel provides an internal loopback capability for system diagnostic. The internal loopback
mode is enabled by setting MCR register bit [4] to logic 1. All regular UART functions operate normally.
shows how the modem port signals are re-configured. Transmit data from the transmit shift register
output is internally routed to the receive shift register input allowing the system to receive the same data that it
was sending. The TX pin is held at HIGH or mark condition while RTS# and DTR# are de-asserted, and CTS#,
DSR# CD# and RI# inputs are ignored.
4.5
UART CHANNEL CONFIGURATION REGISTERS AND ADDRESS DECODING
The 2 sets of UART configuration registers are decoded using address lines A9 to A11 as shown below.
Address lines A0 to A3 select the 16 registers in each channel. The first 8 registers are 16550 compatible with
EXAR enhanced feature registers located on the upper 8 addresses.
FIGURE 14. INTERNAL LOOP BACK
A11
A10
A9
UART CHANNEL
SELECTION
0
1
TX [1:0]
RX [1:0]
Mo
de
m
/
G
e
ne
ra
lPur
p
o
s
e
C
o
nt
ro
l
Lo
gi
c
In
te
rn
al
Bus
Line
s
and
Control
Si
gna
ls
RTS# [1:0]
MCR bit-4=1
VCC
Transmit Shift
Register
Receive Shift
Register
CTS# [1:0]
DTR# [1:0]
DSR# [1:0]
RI# [1:0]
CD# [1:0]
OP1#
OP2#
RTS#
CTS#
DTR#
DSR#
RI#
CD#
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