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參數(shù)資料
| 型號： | XE8802MI035LF |
| 廠商： | Semtech |
| 文件頁數(shù)： | 81/193頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DAS 16BIT FLASH 8K 100-LQFP |
| 標準包裝： | 90 |
| 系列： | XE880x |
| 應(yīng)用： | 感測機 |
| 核心處理器： | Coolrisc816? |
| 程序存儲器類型： | 閃存（22 kB） |
| 控制器系列： | XE8000 |
| RAM 容量： | 1K x 8 |
| 接口： | SPI，UART |
| 輸入/輸出數(shù)： | 36 |
| 電源電壓： | 2.4 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 包裝： | 托盤 |
| 供應(yīng)商設(shè)備封裝： | 100-LQFP（14x14） |
| 產(chǎn)品目錄頁面： | 585 (CN2011-ZH PDF) |
| 配用： | XE8000MP-ND - PROG BOARD AND PROSTART2 CARD |
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Semtech 2006
www.semtech.com
19-27
XE8802 Sensing Machine Data Acquisition MCU
with ZoomingADC and LCD driver
As can be seen from Table 19-28, the voltage V3 on the pins pad_lcd_io[31:12] can not be dissociated from the
voltage V3 on the pins pad_lcd_com0, pad_lcd_com1 and the internal voltage multiplier/divider. It means that, if V3
is not a low impedance external voltage as in the previous section, they can be used for the LCD driver only and
not for digital I/O.
Figure 19-21 and Table 19-29 show an example. In this case, the pins pad_lcd_io[29:12] are used to drive a
display with 1:4 multiplexing (LcdSe15=LcdSe19=LcdSe23=Lcd27=Lcd31=1 in RegLcdSe and LcdMux=11 in
RegLcdOn). In 1:4 multiplexing, the lines pad_lcd_io[31:30] are used for COM2 and COM3. The voltage V3 for the
display is generated by the internal voltage multiplier/divider using the internal reference (VgenOff=0,
VgenRefEn=1, VgenMode=0 in RegVgenCfg0). The segment status is set by using the RegLcdDataN registers
with 6
≤N≤15. Writing in the registers with 0≤N≤5 will have no effect. The pins pad_lcd_io[11:0] are used as digital
I/O (LcdSe3=LcdSe7=LcdSe11=0 in RegLcdSe). The control of the digital I/O is done using the registers
RegPLcdInN, RegPLcdOutN, RegPLcdDirN and RegPLcdPullupN with 0
≤N≤1. Writing in the registers with
2
≤N≤3 will have no effect. The pins pad_lcd_io[11:4] and pad_lcd_io[3:0] can further be split into two different
voltage domains. The voltage domains VDD1, VDD2, V3 and VBAT are independent. The only limitation is that
VDD1>VREG and VDD2>VREG. In the example V3=3.6V, VBAT could be at 2.7V, VDD1 at 2.4V and VDD2 at 5V.
Register
Contents[7:0]
RegVgenCfg0
xx110001
RegLcdOn
xxxxx011
RegLcdSe
00011111
Table 19-29. Register contents for configuration of Figure 19-21.
19.8
Specifications
19.8.1
pad_lcd_io used in LCD mode
Specification
Min
Typ
Max
Unit
Description
Comments
V1
1.1
VBAT
V
V2, V3
1.1
5.5
V
trise-fall
25
s
Rise/Fall time (LCD mode)
(1) (2) (3)
(1) rise or fall time from 10% to 90% of the output signal
(2) Cload=5000pF
(3) V1=V2/2=V3/3=1.1V (1/3 bias) or V1=V2=V3/2=1.1V (1/2 bias)
19.8.2
pad_lcd_io used in digital I/O mode
Specification
Min
Typ
Max
Unit
Description
Comments
pad_lcd_vr1
VREG
5.5
V
pad supply voltage
pad_lcd_vr2
VREG
5.5
V
pad supply voltage
pad_vgen_v3
VREG
5.5
V
pad supply voltage
R_pullud
35
100
k
Pull up/down resistance
trise-fall
1
s
Rise/Fall time
(1) (2)
IOD
8
mA
Output current drive
(3)
(1) rise or fall time from 10% to 90% of the output signal
(2) with Cload=5nF, pad_vgen_v3=pad_lcd_vr1=pad_lcd_vr2=2.4V
(3) pad_vgen_v3=pad_lcd_vr1=pad_lcd_vr2=4.5V, voltage on pad_lcd_io=0.4V for sink current and 4.1V for
source current.
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