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參數(shù)資料
| 型號： | XE8802MI035LF |
| 廠商： | Semtech |
| 文件頁數(shù)： | 28/193頁 |
| 文件大小： | 0K |
| 描述： | IC DAS 16BIT FLASH 8K 100-LQFP |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | XE880x |
| 應(yīng)用： | 感測機(jī) |
| 核心處理器： | Coolrisc816? |
| 程序存儲器類型： | 閃存（22 kB） |
| 控制器系列： | XE8000 |
| RAM 容量： | 1K x 8 |
| 接口： | SPI，UART |
| 輸入/輸出數(shù)： | 36 |
| 電源電壓： | 2.4 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 包裝： | 托盤 |
| 供應(yīng)商設(shè)備封裝： | 100-LQFP（14x14） |
| 產(chǎn)品目錄頁面： | 585 (CN2011-ZH PDF) |
| 配用： | XE8000MP-ND - PROG BOARD AND PROSTART2 CARD |
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Semtech 2006
www.semtech.com
17-11
XE8802 Sensing Machine Data Acquisition MCU
with ZoomingADC and LCD driver
REF
D
ADC
IN
V
GDoff
V
GD
V
=
3
2
3
,
(V)
(Eq. 7)
where GD3 and GDoff3 are respectively the gain and offset of PGA3 (in V/V). The control words are
PGA3_GAIN[6:0]
and PGA3_OFFSET[6:0] . To remain within the signal compliance of the PGA stages, the
condition:
DD
D
V
<
2
1 ,
(V)
(Eq. 8)
must be verified.
Finally, combining equations Eq. 5 to Eq. 7 for the three PGA stages, the input voltage VIN,ADC of the ADC is
related to VIN by:
REF
TOT
IN
TOT
ADC
IN
V
GDoff
V
GD
V
=
,
(V)
(Eq. 9)
where the total PGA gain is defined as:
1
2
3
GD
TOT
=
(V/V)
(Eq. 10)
and the total PGA offset is:
2
3
GDoff
GD
GDoff
TOT
+
=
(V/V)
(Eq. 11)
17.7
ADC Characteristics
The main performance characteristics of the ADC (resolution, conversion time, etc.) are determined by three
programmable parameters:
sampling frequency fS,
over-sampling ratio OSR, and
number of elementary conversions NELCONV.
The setting of these parameters and the resulting performances are described hereafter.
17.7.1
Conversion Sequence
A conversion is started each time the bit START or the bit DEF is set. As depicted in Figure 17-5, a complete
analog-to-digital conversion sequence is made of a set of NELCONV elementary incremental conversions and a final
quantitative step. Each elementary conversion is made of (OSR+1) sampling periods TS=1/fS, i.e.:
S
ELCONV
f
OSR
T
/
)
1
(
+
=
(s)
(Eq. 12)
The result is the mean of the elementary conversion results. An important feature is that the elementary
conversions are alternatively performed with the offset of the internal amplifiers contributing in one direction and the
other to the output code. Thus, converter internal offset is eliminated if at least two elementary sequences are
performed (i.e. if NELCONV ≥ 2). A few additional clock cycles are also required to initiate and end the conversion
properly.
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