參數(shù)資料
型號： XE8801AMI027LF
廠商： Semtech
文件頁數(shù)： 124/135頁
文件大?。?/td> 0K
描述： IC DAS 16BIT FLASH 8K MTP 44LQFP
標準包裝： 800
系列： XE880x
應(yīng)用： 感測機
核心處理器： Coolrisc816?
程序存儲器類型： 閃存（22 kB）
控制器系列： XE8000
RAM 容量： 512 x 8
接口： UART，USRT
輸入/輸出數(shù)： 24
電源電壓： 2.4 V ~ 5.5 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 44-VFQFN 裸露焊盤
包裝： 托盤
供應(yīng)商設(shè)備封裝： 44-MLPQ（7x7）
產(chǎn)品目錄頁面： 585 (CN2011-ZH PDF)
配用： XE8000MP-ND - PROG BOARD AND PROSTART2 CARD
Semtech 2005
www.semtech.com
16-4
XE8801A – SX8801R
pos.
RegAcCfg2
rw
reset
description
7:6
FIN[1:0]
r w
00 resetsystem
Sampling frequency selection
5:4
PGA2_GAIN[1:0]
r w
00 resetsystem
PGA2 stage gain selection
3:0
PGA2_OFFSET[3:0]
r w
0000
resetsystem
PGA2 stage offset selection
Table 16-6: RegAcCfg2
pos.
RegAcCfg3
rw
reset
description
7
PGA1_GAIN
r w
0 resetsystem
PGA1 stage gain selection
6:0
PGA3_GAIN[6:0]
r w
0000000
resetsystem
PGA3 stage gain selection
Table 16-7: RegAcCfg3
pos.
RegAcCfg4
rw
reset
description
7
reserved
r
0
Unused
6:0
PGA3_OFFSET[6:0]
r w
0000000
resetsystem
PGA3 stage offset selection
Table 16-8: RegAcCfg4
pos.
RegAcCfg5
rw
reset
description
7
BUSY
r
0 resetsystem
Activity flag
6
DEF
w r0
0
Selects default configuration
5:1
AMUX[4:0]
r w
00000
resetsystem
Input channel configuration selector
0
VMUX
r w
0 resetsystem
Reference channel selector
Table 16-9: RegAcCfg5
16.4
ZoomingADC
Description
Figure 16-2 gives a more detailed description of the acquisition chain.
16.4.1
Acquisition Chain
Figure 16-1 shows the general block diagram of the acquisition chain (AC). A control block (not shown in Figure
16-1) manages all communications with the CoolRisc
microcontroller.
Analog inputs can be selected among eight input channels, while reference input is selected between two differential
channels.
The core of the zooming section is made of three differential programmable amplifiers (PGA). After selection of a
combination of input and reference signals VIN and VREF, the input voltage is modulated and amplified through stages
1 to 3. Fine gain programming up to 1'000V/V is possible. In addition, the last two stages provide programmable
offset. Each amplifier can be bypassed if needed.
The output of the PGA stages is directly fed to the analog-to-digital converter (ADC), which converts the signal
VIN,ADC into digital.
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