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參數(shù)資料
| 型號(hào)： | XE8000EV120 |
| 廠商： | Semtech |
| 文件頁數(shù)： | 61/108頁 |
| 文件大?。?/td> | 0K |
| 描述： | BOARD EVAL FOR SX8722I070TRLF |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | ZoomingADC™ |
| ADC 的數(shù)量： | 1 |
| 位數(shù)： | 16 |
| 數(shù)據(jù)接口： | I²C |
| 工作溫度： | -40°C ~ 125°C |
| 已用 IC / 零件： | SX8722 |
| 已供物品： | 板，CD |
| 產(chǎn)品目錄頁面： | 585 (CN2011-ZH PDF) |
| 相關(guān)產(chǎn)品： | SX8722I070LFDKR-ND - IC ZOOMING ADC 10BIT 16CH 44MLPQ SX8722I070LFCT-ND - IC ZOOMING ADC 10BIT 16CH 44MLPQ SX8722I070LFTR-ND - IC ZOOMING ADC 10BIT 16CH 44MLPQ |
| 其它名稱： | XM8000EV120 XM8000EV120-ND |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁當(dāng)前第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁
ACS - Revision 4.2
October 2008
2008 Semtech Corp.
www.semtech.com
Page 56
ADVANCED COMMUNICATIONS & SENSING
DATASHEET
SX8722
High gain acquisition for sensor interface
12.5. ZoomingADC registers table
In table below the configuration of the peripheral registers is detailed. The system has a bank of eight 8-bit registers: six
registers are used to configure the acquisition chain (CxZAdcReg1 to 6), and two registers are used to store the output code
of the analog-to-digital conversion (CxDataOutMSB & LSB).
Table 40. ZoomingADC registers
Note Bits labelled R are reserved
With:
OUT:
(r) digital output code of the analog-to-digital converter. (MSB = OUT[15])
SET_NELC:
(rw) sets the number of elementary conversions to 2SET_NELC[1:0] . To compensate for offsets, the input signal is
chopped between elementary conversions (1,2,4,8).
SET_OSR:
(rw) sets the over-sampling rate (OSR) of an elementary conversion to 2(3+SET_OSR[2:0]) . OSR = 8, 16, 32, ..., 512,
1024.
CONT:
(rw) setting this bit starts a conversion. A new conversion will automatically begin as long as the bit remains at 1.
IB_AMP_ADC:
(rw) sets the bias current in the ADC to 0.25 x (1+ IB_AMP_ADC[1:0]) of the normal operation current (25, 50, 75 or
100% of nominal current). To be used for low-power, low-speed operation.
IB_AMP_PGA:
(rw) sets the bias current in the PGAs to 0.25 x (1+ IB_AMP_PGA[1:0]) of the normal operation current (25, 50, 75 or
100% of nominal current). To be used for low-power, low-speed operation.
ENABLE:
(rw) enables the ADC modulator (bit 0) and the different stages of the PGAs (PGAi by bit i = 1,2,3). PGA stages that
are disabled are bypassed.
FIN:
(rw) These bits set the sampling frequency of the acquisition chain. Expressed as a fraction of the oscillator frequency,
the sampling frequency is given as: 00 ' 1/4 fRC, 01 ' 1/8 fRC, 10 ' 1/32 fRC, 11' ~8kHz.
PGA1_GAIN:
(rw) sets the gain of the first stage: 0 ' 1, 1 ' 10.
PGA2_GAIN:
(rw) sets the gain of the second stage: 00 ' 1, 01 ' 2, 10 ' 5, 11 ' 10.
Register Name
Bit position
76543210
CxDataOutLSB
OUT[7:0]
CxDataOutMSB
OUT[15:8]
CxZadcReg1
Default values
R
0
SET_NC[1:0]
01
SET_OSR[2:0]
010
R
0
R
0
CxZadcReg2
Default value
IB_AMP_ADC[1:0]
11
IB_AMP_PGA[1:0]
11
ENABLE[3:0]
0001
CxZadcReg3
Default value
FIN[1:0]
00
PGA2_GAIN[1:0]
00
PGA2_OFFSET
0000
CxZadcReg4
Default value
PGA1_GAIN
0
PGA3_GAIN[6:0]
0000000
CxZadcReg5
Default value
0
PGA3_OFFSET[6:0]
0000000
CxZadcReg6
Default value
R
0
R
0
AMUX[4:0]
00000
VMUX
0
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