參數(shù)資料
型號： XE8000EV110
廠商： Semtech
文件頁數(shù)： 123/193頁
文件大小： 0K
描述： EVAL BOARD FOR XE8802AMI035LF
標準包裝： 1
類型： MCU
適用于相關(guān)產(chǎn)品： XE88LC02MI035
所含物品： 完全組裝的評估板
產(chǎn)品目錄頁面： 585 (CN2011-ZH PDF)
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Semtech 2006
www.semtech.com
4-8
XE8802 Sensing Machine Data Acquisition MCU
with ZoomingADC and LCD driver
4.3.11
UART (h0050-h0057)
Name
Address
7
6
5
4
3
2
1
0
RegUartCtrl
h0050
UartEcho
rw,0,glob
UartEnRx
rw,0,glob
UartEnTx
rw,0,glob
UartXRx
rw,0,glob
UartXTx
rw,0,glob
UartBR[2:0]
rw,101,glob
RegUartCmd
h0051
SelXtal
rw,0,glob
r0
UartRcSel[2:0]
rw,000,glob
UartPM
rw,0,glob
UartPE
rw,0,glob
UartWL
rw,1,glob
RegUartTx
h0052
UartTx[7:0]
rw,0000000,glob
RegUartTxSta
h0053
r0
UartTxBusy
r,0,glob
UartTxFull
r,0,glob
RegUartRx
h0054
UartRx[7:0]
r,00000000,glob
RegUartRxSta
h0055
r0
UartRxSErr
r,0,glob
UartRxPErr
r,0,glob
UartRxFErr
r,0,glob
UartRxOerr
rc,0,glob
UartRxBusy
r,0,glob
UartRxFull
r,0,glob
Table 4-14. UART register description
4.3.12
Counter/Timer/PWM registers (h0058-h005F)
Name
Address
7
6
5
4
3
2
1
0
RegCntA
h0058
CounterA[7:0]
s,00000000,glob
RegCntB
h0059
CounterB[7:0]
s,00000000,glob
RegCntC
h005A
CounterC[7:0]
s,00000000,glob
RegCntD
h005B
CounterD[7:0]
s,00000000,glob
RegCntCtrlCk
h005C
CntDCkSel[1:0]
rw,00,glob
CntCCkSel[1:0]
rw,00,glob
CntBCkSel[1:0]
rw,00,glob
CntACkSel[1:0]
rw,00,glob
RegCntConfig1
h005D
CntDDownUp
rw,0,glob
CntCDownUp
rw,0,glob
CntBDownUp
rw,0,glob
CntADownUp
rw,0,glob
CascadeCD
rw,0,glob
CascadeAB
rw,0,glob
CntPWM1
rw,0,glob
CntPWM0
rw,0,glob
RegCntConfig2
h005E
CapSel[1:0]
rw,00,glob
CapFunc[1:0]
rw,00,glob
Pwm1Size[1:0]
rw,00,glob
Pwm0Size[1:0]
rw,00,glob
RegCntOn
h005F
CntDExtDiv
rw,0,glob
CntCExtDiv
rw,0,glob
CntBExtDiv
rw,0,glob
CntAExtDiv
rw,0,glob
CntDEnable
rw,0,glob
CntCEnable
rw,0,glob
CntBEnable
rw,0,glob
CntAEnable
rw,0,glob
Table 4-15. Counter/timer/PWM register description.
4.3.13
Acquisition chain registers (h0060-h0067)
Name
Address
7
6
5
4
3
2
1
0
RegAcOutLsb
h0060
OUT[7:0]
r,0,glob
RegAcOutMsb
h0061
OUT[15:8]
r,0,glob
RegAcCfg0
h0062
START
w r0,0,glob
SET_NELCONV[1:0]
rw,01,glob
SET_OSR[2:0]
rw,010,glob
CONT
rw,0,glob
r0
RegAcCfg1
h0063
IB_AMP_ADC[1:0]
rw,11,glob
IB_AMP_PGA[1:0]
rw,11,glob
ENABLE[3:0]
rw,0000,glob
RegAcCfg2
h0064
FIN
rw,00,glob
PGA2_GAIN[1:0]
rw,00,glob
PGA2_OFFSET[3:0]
rw,0000,glob
RegAcCfg3
h0065
PGA1_GAIN
Rw,0,glob
PGA3_GAIN[6:0]
rw,0000000,glob
RegAcCfg4
h0066
r0
PGA3_OFFSET
rw,0000000,glob
RegAcCfg5
h0067
BUSY
r,0,glob
DEF
w r0
AMUX[4:0]
rw,00000,glob
VMUX
rw,0,glob
Table 4-16. Acquisition chain register description.
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