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參數(shù)資料
| 型號： | XCV812E-7BG560C |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 18/118頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 1.8V C-TEMP 560-MBGA |
| 產(chǎn)品變化通告： | FPGA Family Discontinuation 18/Apr/2011 |
| 標準包裝： | 1 |
| 系列： | Virtex®-E EM |
| LAB/CLB數(shù)： | 4704 |
| 邏輯元件/單元數(shù)： | 21168 |
| RAM 位總計： | 1146880 |
| 輸入/輸出數(shù)： | 404 |
| 門數(shù)： | 254016 |
| 電源電壓： | 1.71 V ~ 1.89 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 560-LBGA，金屬 |
| 供應商設備封裝： | 560-MBGA（42.5x42.5） |
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Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays
Module 4 of 4
DS025-4 (v3.0) March 21, 2014
38
R
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
25
0
B12
G13
-
26
0
K13
A12
√
-
27
0
B13
F13
√
VREF
28
0
E13
G14
-
29
0
B14
D14
-
30
0
J14
A14
√
-
31
0
J15
K14
√
VREF
34
1
E16
A15
-
GCLK LVDS 3/2
35
1
F16
B16
-
36
1
H16
A16
-
37
1
K15
C16
√
VREF
38
1
G16
K16
√
-
39
1
E17
A17
-
40
1
C17
F17
-
41
1
A18
E18
√
VREF
42
1
A19
D18
√
-
43
1
G18
B19
-
44
1
H18
D19
-
45
1
F19
F18
√
VREF
46
1
K17
B20
√
-
48
1
C20
G19
√
-
49
1
E20
K18
√
-
51
1
A21
F20
√
-
52
1
A22
C21
√
VREF
53
1
B22
H19
-
54
1
D22
E21
-
55
1
C22
F21
√
VREF
56
1
E22
H20
√
-
57
1
A23
G21
-
58
1
K19
A24
-
59
1
B24
C24
√
VREF
60
1
G22
H21
√
-
61
1
C25
E23
-
62
1
A26
D24
-
63
1
K20
B26
√
VREF
64
1
J21
D25
√
-
66
1
G23
B27
√
-
Table 6:
FG900 Differential Pin Pair Summary —
XCV812E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
67
1
F24
A27
√
-
69
1
C27
K21
√
CS
70
2
J22
E27
√
DIN_D0
72
2
G25
E25
√
-
73
2
E28
C30
-
75
2
D30
J23
-
76
2
L21
F28
√
VREF
77
2
G28
E30
√
-
78
2
G27
E29
-
79
2
K23
H26
-
80
2
F30
L22
√
VREF
81
2
H27
G29
√
-
82
2
G30
M21
√
-
83
2
J24
J26
-
84
2
H30
L23
-
VREF
86
2
J29
K24
-
88
2
M22
K29
-
D2
90
2
N21
K25
√
-
91
2
L24
L27
-
93
2
L26
L28
-
94
2
L30
M27
√
VREF
95
2
M26
M29
√
-
96
2
N29
M30
-
97
2
N25
N27
-
98
2
N30
P21
√
D3
99
2
N26
P28
√
-
100
2
P29
N24
√
-
101
2
P22
R26
-
102
2
P25
R29
-
VREF
104
2
R25
T30
-
106
3
R24
U29
-
TRDY
107
3
R22
T27
-
108
3
R23
T28
-
109
3
T21
T25
-
VREF
110
3
U28
U30
-
111
3
T23
U27
√
-
112
3
U25
V27
√
-
Table 6:
FG900 Differential Pin Pair Summary —
XCV812E
Pair
Bank
P
Pin
N
Pin
AO
Other
Functions
相關PDF資料 |
PDF描述 |
|---|---|
| AMM36DRUH | CONN EDGECARD 72POS .156 DIP SLD |
| FMM28DSEN-S243 | CONN EDGECARD 56POS .156 EYELET |
| XC5VLX110-2FF1760C | IC FPGA VIRTEX-5 110K 1760FBGA |
| XC5VLX110-2FF1153C | IC FPGA VIRTEX-5 110K 1153FBGA |
| XC6VLX240T-1FFG1156I | IC FPGA VIRTEX 6 241K 1156FFGBGA |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| XCV812E-7BG560I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays |
| XCV812E-7BG676C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays |
| XCV812E-7BG676I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays |
| XCV812E-7BG900C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays |
| XCV812E-7BG900I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-E 1.8 V Extended Memory Field Programmable Gate Arrays |
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