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參數(shù)資料
| 型號(hào)： | XCV300E-8BG432C |
| 廠商： | Xilinx Inc |
| 文件頁數(shù)： | 189/233頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC FPGA 1.8V C-TEMP 432-MBGA |
| 產(chǎn)品變化通告： | FPGA Family Discontinuation 18/Apr/2011 |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | Virtex®-E |
| LAB/CLB數(shù)： | 1536 |
| 邏輯元件/單元數(shù)： | 6912 |
| RAM 位總計(jì)： | 131072 |
| 輸入/輸出數(shù)： | 316 |
| 門數(shù)： | 411955 |
| 電源電壓： | 1.71 V ~ 1.89 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 432-LBGA，金屬 |
| 供應(yīng)商設(shè)備封裝： | 432-MBGA（40x40） |
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Virtex-E 1.8 V Field Programmable Gate Arrays
R
DS022-2 (v3.0) March 21, 2014
Module 2 of 4
Production Product Specification
53
— OBSOLETE — OBSOLETE — OBSOLETE — OBSOLETE —
09/20/2000
1.7
Min values added to Virtex-E Electrical Characteristics tables.
XCV2600E and XCV3200E numbers added to Virtex-E Electrical Characteristics
tables (Module 3).
Corrected user I/O count for XCV100E device in Table 1 (Module 1).
Changed several pins to “No Connect in the XCV100E“ and removed duplicate VCCINT
pins in Table ~ (Module 4).
Changed pin J10 to “No connect in XCV600E” in Table 74 (Module 4).
Changed pin J30 to “VREF option only in the XCV600E” in Table 74 (Module 4).
Corrected pair 18 in Table 75 (Module 4) to be “AO in the XCV1000E, XCV1600E“.
11/20/2000
1.8
Upgraded speed grade -8 numbers in Virtex-E Electrical Characteristics tables to
Preliminary.
Updated minimums in Table 13 and added notes to Table 14.
Added to note 2 to Absolute Maximum Ratings.
Changed speed grade -8 numbers for TSHCKO32, TREG, TBCCS, and TICKOF.
Changed all minimum hold times to –0.4 under Global Clock Set-Up and Hold for
LVTTL Standard, with DLL.
Revised maximum TDLLPW in -6 speed grade for DLL Timing Parameters.
Changed GCLK0 to BA22 for FG860 package in Table 46.
02/12/2001
1.9
Revised footnote for Table 14.
Added numbers to Virtex-E Electrical Characteristics tables for XCV1000E and
XCV2000E devices.
Updated Table 27 and Table 78 to include values for XCV400E and XCV600E devices.
Revised Table 62 to include pinout information for the XCV400E and XCV600E
devices in the BG560 package.
Updated footnotes 1 and 2 for Table 76 to include XCV2600E and XCV3200E devices.
04/02/2001
2.0
Updated numerous values in Virtex-E Switching Characteristics tables.
Converted data sheet to modularized format. See the Virtex-E Data Sheet section.
04/19/2001
2.1
Modified Figure 30 "DLL Generation of 4x Clock in Virtex-E Devices."
07/23/2001
2.2
Made minor edits to text under Configuration.
Added CLB column locations for XCV2600E anbd XCV3200E devices in Table 3.
11/09/2001
2.3
Added warning under Configuration section that attempting to load an incorrect
bitstream causes configuration to fail and can damage the device.
07/17/2002
2.4
Data sheet designation upgraded from Preliminary to Production.
09/10/2002
2.5
11/19/2002
2.6
Added clarification in the Boundary Scan section.
Removed last sentence regarding deactivation of duty-cycle correction in Duty Cycle
Correction Property section.
06/15/2004
2.6.1
Updated clickable web addresses.
01/12/2006
2.7
Updated the Slave-Serial Mode and the Master-Serial Mode sections.
01/16/2006
2.8
Made minor updates to Table 8.
03/21/2014
3.0
Date
Version
Revision
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| HMC60DRTH-S734 | CONN EDGECARD 120PS DIP .100 SLD |
| XCV300E-7BG432I | IC FPGA 1.8V I-TEMP 432-MBGA |
| HMC60DREN-S734 | CONN EDGECARD 120PS .100 EYELET |
| 745538-8 | CONN CASSETTE 33POS RCPT KIT 4PC |
| HMC60DREH-S734 | CONN EDGECARD 120PS .100 EYELET |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XCV300E-8BG432C0773 | 制造商:Rochester Electronics LLC 功能描述: 制造商:Xilinx 功能描述: |
| XCV300E-8BG432I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Virtex-E 1.8 V Field Programmable Gate Arrays |
| XCV300E8BGG432C | 制造商:Xilinx 功能描述: |
| XCV300E-8CS144C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Field Programmable Gate Arrays |
| XCV300E-8CS144I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Field Programmable Gate Arrays |
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