Table 45:" /> 

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    參數(shù)資料
    

    


    


    
型號(hào)：
XC5VLX50T-1FF1136C

    

    
廠商：
Xilinx Inc

    

    
文件頁數(shù)：
16/91頁

    

    
文件大?。?/td>
0K

    

    
描述：
IC FPGA VIRTEX-5 50K 1136FBGA

    

    
產(chǎn)品變化通告：
Step Intro and Pkg Change 11/March/2008
    		

    

    
標(biāo)準(zhǔn)包裝：
1

    

    
系列：
Virtex®-5 LXT

    

    
LAB/CLB數(shù)：
3600
    		

    

    
邏輯元件/單元數(shù)：
46080
    		

    

    
RAM 位總計(jì)：
2211840
    		

    

    
輸入/輸出數(shù)：
480
    		

    

    
電源電壓：
0.95 V ~ 1.05 V
    		

    

    
安裝類型：
表面貼裝
    		

    

    
工作溫度：
0°C ~ 85°C
    		

    

    
封裝/外殼：
1136-BBGA，F(xiàn)CBGA
    		

    

    
供應(yīng)商設(shè)備封裝：
1136-FCBGA
    		

    

    
配用：
568-5088-ND - BOARD DEMO DAC1408D750
    122-1586-ND - BOARD EVAL FOR VIRTEX-5 ML555
    HW-V5-ML561-UNI-G-ND - EVALUATION PLATFORM VIRTEX-5
    HW-V5-ML550-UNI-G-ND - EVALUATION PLATFORM VIRTEX-5
    HW-V5-ML521-UNI-G-ND - EVALUATION PLATFORM VIRTEX-5
    HW-AFX-FF1136-500-G-ND - BOARD DEV VIRTEX 5 FF1136
    HW-V5GBE-DK-UNI-G-ND - KIT DEV V5 LXT GIGABIT ETHERNET
    122-1508-ND - EVALUATION PLATFORM VIRTEX-5
    		

    

    

    

	
    
    
    

    
    
	
    Virtex-5 FPGA Data Sheet: DC and Switching Characteristics
    DS202 (v5.3) May 5, 2010
    Product Specification
    23
    Table 45: GTX_DUAL Tile User Clock Switching Characteristics(1)
    Symbol
    Description
    Conditions
    Device
    Speed Grade
    Units
    -3
    -2
    -1
    FTXOUT
    TXOUTCLK maximum frequency
    Internal 20-bit datapath
    FXT
    325
    212.5
    MHz
    TXT
    -
    325
    212.5
    MHz
    Internal 16-bit datapath
    FXT
    406.25
    265.625
    MHz
    TXT
    -
    406.25
    265.625
    MHz
    FRXREC
    RXRECCLK maximum frequency
    FXT
    406.25
    265.625
    MHz
    TXT
    -
    406.25
    265.625
    MHz
    TRX
    RXUSRCLK maximum frequency
    FXT
    406.25
    265.625
    MHz
    TXT
    -
    406.25
    265.625
    MHz
    TRX2
    RXUSRCLK2 maximum frequency
    1 byte interface
    FXT
    375
    312.5
    235.625
    MHz
    2 byte interface
    406.25
    390.625
    265.625
    MHz
    4 byte interface
    203.125
    132.813
    MHz
    1 byte interface
    TXT
    -
    312.5
    235.625
    MHz
    2 byte interface
    -
    265.625
    MHz
    4 byte interface
    -
    203.125
    132.813
    MHz
    TTX
    TXUSRCLK maximum frequency
    FXT
    406.25
    265.625
    MHz
    TXT
    -
    406.25
    265.625
    MHz
    TTX2
    TXUSRCLK2 maximum frequency
    1 byte interface
    FXT
    375
    312.5
    235.625
    MHz
    2 byte interface
    406.25
    390.625
    265.625
    MHz
    4 byte interface
    203.125
    132.813
    MHz
    1 byte interface
    TXT
    -
    312.5
    235.625
    MHz
    2 byte interface
    -
    265.625
    MHz
    4 byte interface
    -
    203.125
    132.813
    MHz
    Notes:
    1.
    Clocking must be implemented as described in UG198: Virtex-5 FPGA RocketIO GTX Transceiver User Guide.
    Table 46: GTX_DUAL Tile Transmitter Switching Characteristics
    Symbol
    Description
    Condition
    Min
    Typ
    Max
    Units
    FGTXTX
    Serial data rate range
    0.15
    FGTXMAX
    Gb/s
    TRTX
    TX Rise time
    20%–80%
    120
    ps
    TFTX
    TX Fall time
    80%–20%
    120
    ps
    TLLSKEW
    TX lane-to-lane skew(1)
    350
    ps
    VTXOOBVDPP
    Electrical idle amplitude
    15
    mV
    TTXOOBTRANSITION
    Electrical idle transition time
    75
    ns
    TJ6.5
    Total Jitter(2)
    6.5 Gb/s
    0.33
    UI
    DJ6.5
    Deterministic Jitter(2)
    0.17
    UI
    TJ5.0
    Total Jitter(2)
    5.0 Gb/s
    0.33
    UI
    DJ5.0
    Deterministic Jitter(2)
    0.15
    UI
    TJ4.25
    Total Jitter(2)
    4.25 Gb/s
    0.33
    UI
    DJ4.25
    Deterministic Jitter(2)
    0.14
    UI
    
    
    
    
    
    


    


    

    相關(guān)PDF資料
    		

    PDF描述
    		

    
    

    
XC5VLX50T-1FFG1136C
IC FPGA VIRTEX-5 50K 1136FBGA

    

    
AT24C02C-XHM-T
IC EEPROM 2KBIT 1MHZ 8TSSOP

    

    
XC2V1500-4FF896I
IC FPGA VIRTEX-II 896FCBGA

    

    
AT24C02C-STUM-T
IC EEPROM 2KBIT 1MHZ SOT23-5

    

    
XC2V1500-5FFG896C
IC FPGA VIRTEX-II 1.5M 896-FBGA

    

    

    

    


    


    

    相關(guān)代理商/技術(shù)參數(shù)
    		

    參數(shù)描述
    		

    
    

    
XC5VLX50T-1FF1136CES
 制造商:Xilinx 功能描述:

    

    
XC5VLX50T-1FF1136I
功能描述:IC FPGA VIRTEX-5 50K 1136FBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:Virtex®-5 LXT 產(chǎn)品變化通告:Step Intro and Pkg Change 11/March/2008 標(biāo)準(zhǔn)包裝:1 系列:Virtex®-5 SXT LAB/CLB數(shù):4080 邏輯元件/單元數(shù):52224 RAM 位總計(jì):4866048 輸入/輸出數(shù):480 門數(shù):- 電源電壓:0.95 V ~ 1.05 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:1136-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:1136-FCBGA 配用:568-5088-ND - BOARD DEMO DAC1408D750122-1796-ND - EVALUATION PLATFORM VIRTEX-5

    

    
XC5VLX50T-1FF1138CES
 制造商:Xilinx 功能描述:

    

    
XC5VLX50T-1FF665C
功能描述:IC FPGA VIRTEX-5 50K 665FCBGA RoHS:否 類別:集成電路 (IC) >> 嵌入式 - FPGA（現(xiàn)場(chǎng)可編程門陣列） 系列:Virtex®-5 LXT 產(chǎn)品變化通告:Step Intro and Pkg Change 11/March/2008 標(biāo)準(zhǔn)包裝:1 系列:Virtex®-5 SXT LAB/CLB數(shù):4080 邏輯元件/單元數(shù):52224 RAM 位總計(jì):4866048 輸入/輸出數(shù):480 門數(shù):- 電源電壓:0.95 V ~ 1.05 V 安裝類型:表面貼裝 工作溫度:-40°C ~ 100°C 封裝/外殼:1136-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:1136-FCBGA 配用:568-5088-ND - BOARD DEMO DAC1408D750122-1796-ND - EVALUATION PLATFORM VIRTEX-5

    

    
XC5VLX50T-1FF665CES
 制造商:Xilinx 功能描述:

    

    
    
    
    
	
    	
    
    
     
     
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                                    *型號(hào)
                                    *數(shù)量
                                    廠商
                                    批號(hào)
                                    封裝
                                  
    
                                    
                                
                                
    
                                    
                                        
    
                                            
                                            
                                        
    
                                        		
                                     
                                    
                                        
    
                                        		
                                    
                                        
    
                                        		
                                    
                                        
    
                                        		
                                    
                                        
    
                                        		
                                  
    
                                  
                                   
                                    
                            
    
                             
                             
							                            
    
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    我的聯(lián)系方式
    
                     
                     
                       
    
                                
                                
                                
    
                                    
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                                         *
                                    
                                    
                                  
    
                                  
                                  
    
                                    
                                        
                                    
                                    
                                  
    
                                  
                                  
    
                                    
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