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參數資料
| 型號： | XC3S1000-4FG456I |
| 廠商： | XILINX INC |
| 元件分類： | FPGA |
| 英文描述： | Spartan-3 FPGA Family : Complete Data Sheet |
| 中文描述： | FPGA, 1920 CLBS, 1000000 GATES, 630 MHz, PBGA456 |
| 封裝： | 23 X 23 MM, FBGA-456 |
| 文件頁數： | 3/192頁 |
| 文件大小： | 1555K |
| 代理商： | XC3S1000-4FG456I |
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Spartan-3 FPGA Family: Introduction and Ordering Information
2
www.xilinx.com
1-800-255-7778
DS099-1 (v1.2) December 24, 2003
Advance Product Specification
6
R
Architectural Overview
The Spartan-3 family architecture consists of five funda-
mental programmable functional elements:
Configurable Logic Blocks (CLBs) contain RAM-based
Look-Up Tables (LUTs) to implement logic and storage
elements that can be used as flip-flops or latches.
CLBs can be programmed to perform a wide variety of
logical functions as well as to store data.
Input/Output Blocks (IOBs) control the flow of data
between the I/O pins and the internal logic of the
device. Each IOB supports bidirectional data flow plus
3-state
operation.
Twenty-four
standards,
including
differential standards, are available as shown in
Table 2
. Double Data-Rate (DDR) registers are
included. The Digitally Controlled Impedance (DCI)
feature provides automatic on-chip terminations,
simplifying board designs.
Block RAM provides data storage in the form of 18-Kbit
dual-port blocks.
different
high-performance
signal
seven
Multiplier blocks accept two 18-bit binary numbers as
inputs and calculate the product.
Digital
Clock
Manager
self-calibrating, fully digital solutions for distributing,
delaying, multiplying, dividing, and phase shifting clock
signals.
These elements are organized as shown in
Figure 1
. A ring
of IOBs surrounds a regular array of CLBs. The XC3S50
has a single column of block RAM embedded in the array.
Those devices ranging from the XC3S200 to the XC3S2000
have two columns of block RAM. The XC3S4000 and
XC3S5000 devices have four RAM columns. Each column
is made up of several 18K-bit RAM blocks; each block is
associated with a dedicated multiplier. The DCMs are posi-
tioned at the ends of the outer block RAM columns.
The Spartan-3 family features a rich network of traces and
switches that interconnect all five functional elements,
transmitting signals among them. Each functional element
has an associated switch matrix that permits multiple con-
nections to the routing.
(DCM)
blocks
provide
Figure 1:
Spartan-3 Family Architecture
DS099-1_01_032703
Notes:
1.
The two additional block RAM columns of the XC3S4000 and XC3S5000
devices are shown with dashed lines. The XC3S50 has only the block RAM
column on the far left.
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