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參數(shù)資料
| 型號(hào)： | XC2S150-5PQG208C |
| 廠商： | Xilinx Inc |
| 文件頁(yè)數(shù)： | 60/99頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC SPARTAN-II FPGA 150K 208-PQFP |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 系列： | Spartan®-II |
| LAB/CLB數(shù)： | 864 |
| 邏輯元件/單元數(shù)： | 3888 |
| RAM 位總計(jì)： | 49152 |
| 輸入/輸出數(shù)： | 140 |
| 門數(shù)： | 150000 |
| 電源電壓： | 2.375 V ~ 2.625 V |
| 安裝類型： | 表面貼裝 |
| 工作溫度： | 0°C ~ 85°C |
| 封裝/外殼： | 208-BFQFP |
| 供應(yīng)商設(shè)備封裝： | 208-PQFP（28x28） |
| 產(chǎn)品目錄頁(yè)面： | 599 (CN2011-ZH PDF) |
| 其它名稱： | 122-1308 |
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Spartan-II FPGA Family: DC and Switching Characteristics
DS001-3 (v2.8) June 13, 2008
Module 3 of 4
Product Specification
63
R
Figure 52: Period Tolerance and Clock Jitter
Period Tolerance: the allowed input clock period change in nanoseconds.
Output Jitter: the difference between an ideal
reference clock edge and the actual design.
TCLKIN + TIPTOL
_
DS001_52_090800
Actual Period
+
Jitter
+/- Jitter
+ Maximum
Phase Difference
Phase Offset and Maximum Phase Difference
+ Phase Offset
Ideal Period
1
FCLKIN
T
=
CLKIN
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TACR685K010R | CAP TANT 6.8UF 10V 10% 0805 |
| GMC43DRAS-S734 | CONN EDGECARD 86POS .100 R/A SLD |
| AMC18DRYS-S734 | CONN EDGECARD 36POS DIP .100 SLD |
| FMC10DREN-S13 | CONN EDGECARD 20POS .100 EXTEND |
| XC3S250E-4PQG208C | IC SPARTAN-3E FPGA 250K 208-PQFP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| XC2S150-5PQG208I | 制造商:Xilinx 功能描述:FPGA SPARTAN-II 150K GATES 3888 CELLS 263MHZ 2.5V 208PQFP - Trays |
| XC2S150-5TQ144C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-II FPGA Family |
| XC2S150-5TQ144I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-II FPGA Family |
| XC2S150-5TQG144C | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-II FPGA Family |
| XC2S150-5TQG144I | 制造商:XILINX 制造商全稱:XILINX 功能描述:Spartan-II FPGA Family |
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