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參數(shù)資料
| 型號： | UPD78F0545GC(T2)-UBT-A |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, FLASH, 20 MHz, MICROCONTROLLER, PQFP80 |
| 封裝： | 14 X 14 MM, LEAD FREE, PLASTIC, LQFP-80 |
| 文件頁數(shù)： | 50/96頁 |
| 文件大?。?/td> | 4109K |
| 代理商： | UPD78F0545GC(T2)-UBT-A |
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Preliminary Product Information U14673EJ1V0PM00
54
PD789322,789324,789326,789327
(2) LCD clock control register (LCDC0)
This register is used to set the internal and LCD clocks. The frame frequency is determined by the number of
LCD clock time divisions.
LCDC0 is set using a 1-bit or 8-bit memory manipulation instruction.
RESET input sets this register to 00H.
Figure 5-27. Format of LCD Clock Control Register 0
Symbol
7
6
5
4
3
2
1
0
Address
After reset
R/W
LCDC0
0
LCDC03
LCDC02
LCDC01
LCDC00
FFB2H
00H
R/W
LCDC03
LCDC02
Internal clock (fCLK) selection
Note
00
fXT
(32.768 kHz)
01
fX/2
5
(156.3 kHz)
10
fX/2
6
(78.1 kHz)
11
fX/2
7
(39.1 kHz)
LCDC01
LCDC00
LCD clock (fLCD) selection
00
fCLK/2
6
01
fCLK/2
7
10
fCLK/2
8
11
fCLK/2
9
Note Select fX so that a clock of at least 32 kHz is set for the internal clock fCLK.
Remarks 1. fX:
Main system clock oscillation frequency
2. fXT: Subsystem clock oscillation frequency
3. The parenthesized values apply to operation at fX = 5.0 MHz or fXT = 32.768 kHz
Caution
Always set bits 4 to 7 to 0.
Examples of the frame frequencies when the internal clock is fXT (32.768 kHz) are shown in Table 5-14 below.
Table 5-14. Frame Frequency (Hz)
LCD Clock (fLCD)
Time Division
fXT/2
9
(64 Hz)
fXT/2
8
(128 Hz)
fXT/2
7
(256 Hz)
fXT/2
6
(512 Hz)
4
163264
128
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