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參數(shù)資料
| 型號： | UPD784907 |
| 廠商： | NEC Corp. |
| 英文描述： | 16-BIT SINGLE-CHIP MICROCONTROLLER |
| 中文描述： | 16位單片機(jī) |
| 文件頁數(shù)： | 79/98頁 |
| 文件大?。?/td> | 657K |
| 代理商： | UPD784907 |
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μ
PD784907, 784908
Data Sheet U11680EJ2V0DS00
79
(2) IOE1, IOE2 (T
A
= –40 to +85
°
C, V
DD
= AV
DD
= 3.5 to 5.5 V, AV
SS
= V
SS
= 0 V)
Parameter
Symbol
Conditions
MIN.
MAX.
Unit
Serial clock cycle time
(SCK1, SCK2)
t
CYSK1
Input
V
DD
= 4.0 to 5.5 V
640
ns
1,280
ns
Output Internal, divided by 8
T
ns
Serial clock low-level width
(SCK1, SCK2)
t
WSKL1
Input
V
DD
= 4.0 to 5.5 V
280
ns
600
ns
Output Internal, divided by 8
0.5T – 40
ns
Serial clock high-level width
(SCK1, SCK2)
t
WSKH1
Input
V
DD
= 4.0 to 5.5 V
280
ns
600
ns
Output Internal, divided by 8
0.5T – 40
ns
SI1, SI2 setup time
(to SCK1, SCK2
↑
)
t
SSSK1
40
ns
SI1, SI2 hold time
(from SCK1, SCK2
↑
)
t
HSSK1
40
ns
SO1, SO2 output delay time
(from SCK1, SCK2
↑
)
t
DSOSK
0
50
ns
SO1, SO2 output hold time
(from SCK1, SCK2
↑
)
t
HSOSK
When data is transferred
0.5t
CYSK1
– 40
ns
Remarks 1.
The values in this table are those when C
L
= 100 pF.
2.
T: serial clock cycle set by software. The minimum value is 8/f
XX
.
(3) UART, UART2 (T
A
= –40 to +85
°
C, V
DD
= AV
DD
= 3.5 to 5.5 V, AV
SS
= V
SS
= 0 V)
Parameter
Symbol
Conditions
MIN.
MAX.
Unit
ASCK clock input cycle time
t
CYASK
V
DD
= 4.5 to 5.5 V
160
ns
320
ns
ASCK clock low-level width
t
WASKL
V
DD
= 4.5 to 5.5 V
65
ns
120
ns
ASCK clock high-level width
t
WASKH
V
DD
= 4.5 to 5.5 V
65
ns
120
ns
相關(guān)PDF資料 |
PDF描述 |
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