PD720101 AC Characteristics (VDD
參數(shù)資料
型號： UPD720101GJ-UEN-A
廠商： Renesas Electronics America
文件頁數(shù)： 17/38頁
文件大?。?/td> 0K
描述： HOST CTLR USB 2.0 144-LQFP
標準包裝： 100
控制器類型： USB 外設(shè)控制器
接口： PCI
電源電壓： 3 V ~ 3.6 V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-LQFP
包裝： 托盤
其它名稱： 972-1001
Data Sheet S16265EJ5V0DS
22
PD720101
AC Characteristics (VDD = 3.0 to 3.6 V, TA = 0 to
+70°C)
PCI interface block
Parameter
Symbol
Condition
Min.
Max.
Unit
PCI clock cycle time
tcyc
30
ns
PCI clock pulse, high-level width
thigh
11
ns
PCI clock pulse, low-level width
tlow
11
ns
PCI clock, rise slew rate
Scr
0.2VDD to 0.6VDD
1
4
V/ns
PCI clock, fall slew rate
Scf
0.2VDD to 0.6VDD
1
4
V/ns
PCI reset active time (vs. power supply
stability)
trst
1
ms
PCI reset active time (vs. CLK start)
trst-clk
100
s
Output float delay time (vs. RST0
↓)
trst-off
40
ns
PCI reset rise slew rate
Srr
50
mV/ns
PCI bus signal output time (vs. PCLK
↑)
tval
2
11
ns
PCI point-to-point signal output time (vs.
PCLK
↑)
tval (ptp)
REQ0
2
12
ns
Output delay time (vs. PCLK
↑)
ton
2
ns
Output float delay time (vs. PCLK
↑)
toff
28
ns
Input setup time (vs. PCLK
↑)
tsu
7
ns
Point-to-point input setup time (vs.
PCLK
↑)
tsu (ptp)
GNT0
10
ns
Input hold time
th
0
ns
相關(guān)PDF資料
PDF描述
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