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參數(shù)資料
| 型號： | UPD70F3714GC-8BS-A |
| 廠商： | Renesas Electronics America |
| 文件頁數(shù)： | 76/320頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 32BIT V850ES/LX2 64-LQFP |
| 標準包裝： | 300 |
| 系列： | V850ES/Ix2 |
| 核心處理器： | V850ES |
| 芯體尺寸： | 32-位 |
| 速度： | 20MHz |
| 連通性： | CSI，UART/USART |
| 外圍設備： | LVD，PWM，WDT |
| 輸入/輸出數(shù)： | 39 |
| 程序存儲器容量： | 128KB（128K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 6K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 3.5 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 64-LQFP |
| 包裝： | 托盤 |
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2011-2012 Microchip Technology Inc.
Preliminary
DS61168D-page 167
PIC32MX1XX/2XX
bit 16
ENHBUF: Enhanced Buffer Enable bit(2)
1 = Enhanced Buffer mode is enabled
0 = Enhanced Buffer mode is disabled
bit 15
ON: SPI Peripheral On bit(1)
1 = SPI Peripheral is enabled
0 = SPI Peripheral is disabled
bit 14
Unimplemented: Read as ‘0’
bit 13
SIDL: Stop in Idle Mode bit
1 = Discontinue operation when CPU enters in Idle mode
0 = Continue operation in Idle mode
bit 12
DISSDO: Disable SDOx pin bit
1 = SDOx pin is not used by the module. Pin is controlled by associated PORT register
0 = SDOx pin is controlled by the module
bit 11-10 MODE<32,16>: 32/16-Bit Communication Select bits
When AUDEN = 1:
MODE32
MODE16
Communication
11
24-bit Data, 32-bit FIFO, 32-bit Channel/64-bit Frame
10
32-bit Data, 32-bit FIFO, 32-bit Channel/64-bit Frame
01
16-bit Data, 16-bit FIFO, 32-bit Channel/64-bit Frame
00
16-bit Data, 16-bit FIFO, 16-bit Channel/32-bit Frame
When AUDEN = 0:
MODE32
MODE16
Communication
1x
32-bit
01
16-bit
00
8-bit
bit 9
SMP: SPI Data Input Sample Phase bit
Master mode (MSTEN = 1):
1 = Input data sampled at end of data output time
0 = Input data sampled at middle of data output time
Slave mode (MSTEN = 0):
SMP value is ignored when SPI is used in Slave mode. The module always uses SMP = 0.
bit 8
CKE: SPI Clock Edge Select bit(3)
1 = Serial output data changes on transition from active clock state to Idle clock state (see CKP bit)
0 = Serial output data changes on transition from Idle clock state to active clock state (see CKP bit)
bit 7
SSEN: Slave Select Enable (Slave mode) bit
1 = SSx pin used for Slave mode
0 = SSx pin not used for Slave mode, pin controlled by port function.
bit 6
CKP: Clock Polarity Select bit
1 = Idle state for clock is a high level; active state is a low level
0 = Idle state for clock is a low level; active state is a high level
bit 5
MSTEN: Master Mode Enable bit
1 = Master mode
0 =Slave mode
bit 4
DISSDI: Disable SDI bit
1 = SDI pin is not used by the SPI module (pin is controlled by PORT function)
0 = SDI pin is controlled by the SPI module
REGISTER 16-1:
SPIxCON: SPI CONTROL REGISTER (CONTINUED)
Note 1: When using the 1:1 PBCLK divisor, the user’s software should not read or write the peripheral’s SFRs in
the SYSCLK cycle immediately following the instruction that clears the module’s ON bit.
2: This bit can only be written when the ON bit = 0.
3: This bit is not used in the Framed SPI mode. The user should program this bit to ‘0’ for the Framed SPI
mode (FRMEN = 1).
相關PDF資料 |
PDF描述 |
|---|---|
| UPD70F3757GJ-GAE-AX | MCU 32BIT V850ES/HX3 144-LQFP |
| UPD720101GJ-UEN-A | HOST CTLR USB 2.0 144-LQFP |
| UPD720102F1-CA7-A | IC HOST CTLR USB2.0 3-PORT BGA |
| UPD720113GK-9EU-A | IC HUB CTLR USB2.0 7-PORTS QFP |
| UPD78F0394GC-8EA-A | MCU 8BIT 48KB FLASH |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| UPD70F3715GC-8EU-A | 制造商:NEC Electronics Corporation 功能描述:32BIT MCU 128K FLASH 12K RAM SMD |
| UPD70F3716GC-8EA-A | 制造商:NEC Electronics Corporation 功能描述:32BIT MCU 256K FLASH 24K RAM SMD |
| UPD70F3717GC-8EA-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD70F3718GC-8EA-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD70F3719GC(S)-8EA-A | 制造商:NEC Electronics Corporation 功能描述: |
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