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參數(shù)資料
| 型號： | UPD70F3345GJ(A)-GAE-AX |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 32-BIT, FLASH, 32 MHz, RISC MICROCONTROLLER, PQFP144 |
| 封裝： | 20 X 20 MM, LEAD FREE, PLASTIC, LQFP-144 |
| 文件頁數(shù)： | 941/1119頁 |
| 文件大?。?/td> | 6653K |
| 代理商： | UPD70F3345GJ(A)-GAE-AX |
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CHAPTER 19 CAN CONTROLLER
User’s Manual U17790EJ2V0UD
838
19.12 Interrupt Function
The CAN module provides 6 different interrupt sources.
The occurrence of these interrupt sources is stored in interrupt status registers. Four separate interrupt request
signals are generated from the six interrupt sources. When an interrupt request signal that corresponds to two or
more interrupt sources is generated, the interrupt sources can be identified by using an interrupt status register. After
an interrupt source has occurred, the corresponding interrupt status bit must be cleared to 0 by software.
Table 19-20. List of CAN Module Interrupt Sources
Interrupt Status Bit
Interrupt Enable Bit
No.
Name
Register
Name
Register
Interrupt
Request Signal
Interrupt Source Description
1
CINTS0
Note 1
CnINTS
CIE0
Note 1
CnIE
INTCnTRX
Message frame successfully transmitted from
message buffer m
2
CINTS1
Note 1
CnINTS
CIE1
Note 1
CnIE
INTCnREC
Valid message frame reception in message buffer m
3
CINTS2
CnINTS
CIE2
CnIE
CAN module error state interrupt
Note 2
4
CINTS3
CnINTS
CIE3
CnIE
CAN module protocol error interrupt
Note 3
5
CINTS4
CnINTS
CIE4
CnIE
INTCnERR
CAN module arbitration loss interrupt
6
CINTS5
CnINTS
CIE5
CnIE
INTCnWUP
CAN module wakeup interrupt from CAN sleep
mode
Note 4
Notes 1. The CnMCTRL.IE bit (message buffer interrupt enable bit) of the corresponding message buffer has to
be set to 1 for that message buffer to participate in the interrupt generation process.
2. This interrupt is generated when the transmission/reception error counter is at the warning level, or in
the error passive or bus-off state.
3. This interrupt is generated when a stuff error, form error, ACK error, bit error, or CRC error occurs.
4. This interrupt is generated when the CAN module is woken up from the CAN sleep mode because a
falling edge is detected at the CAN reception pin (CAN bus transition from recessive to dominant).
Remark
n = 0, 1
m = 00 to 31
相關PDF資料 |
PDF描述 |
|---|---|
| UPD70F3357GJ(A)-GAE-AX | 32-BIT, FLASH, 32 MHz, RISC MICROCONTROLLER, PQFP144 |
| UPD70F3347GJ | 32-BIT, FLASH, 32 MHz, RISC MICROCONTROLLER, PQFP144 |
| UPD70F3454F1-DA9-A | 32-BIT, FLASH, 64 MHz, RISC MICROCONTROLLER, PBGA161 |
| UPD71087G | 71087 SERIES, 8-BIT TRANSCEIVER, INVERTED OUTPUT, PDSO20 |
| UPD750066CU(A)-XXX | 4-BIT, MROM, MICROCONTROLLER, PDIP42 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| UPD70F3347GJ(A)-UEN | 制造商:NEC Electronics Corporation 功能描述: |
| UPD70F3347GJ-UEN-A | 制造商:NEC Electronics Corporation 功能描述:32BIT MCU 768K FLASH 60K RAM SMD |
| UPD70F3349GJ-UEN-A | 制造商:Renesas Electronics Corporation 功能描述: |
| UPD70F3350GC-8EA-SSA | 制造商:NEC Electronics Corporation 功能描述: |
| UPD70F3350GCA9UEUE2-SSA-A | 制造商:NEC Electronics Corporation 功能描述: |
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