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參數(shù)資料
| 型號： | TMS32C6415CGLSA6E3 |
| 廠商： | Texas Instruments, Inc. |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | FIXED-POINT DIGITAL SIGNAL PROCESSORS |
| 中文描述： | 定點數(shù)字信號處理器 |
| 文件頁數(shù)： | 93/141頁 |
| 文件大?。?/td> | 2234K |
| 代理商： | TMS32C6415CGLSA6E3 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁當前第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁
TMS320C6414, TMS320C6415, TMS320C6416
FIXED-POINT DIGITAL SIGNAL PROCESSORS
SPRS146N
FEBRUARY 2001
REVISED MAY 2005
93
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251
1443
SYNCHRONOUS DRAM TIMING
timing requirements for synchronous DRAM cycles for EMIFA module
(see Figure 27)
NO.
5E0
A
5E0
6E3
A
6E3
7E3
UNIT
MIN
2.1
2.5
MAX
MIN
0.6
1.8
MAX
6
7
t
su(EDV-EKO1H)
t
h(EKO1H-EDV)
Setup time, read EDx valid before ECLKOUTx high
Hold time, read EDx valid after ECLKOUTx high
ns
ns
These C64x
devices have two EMIFs (EMIFA and EMIFB). All EMIFA signals are prefixed by an “A” and all EMIFB signals are prefixed by a
“B”. Throughout the rest of this document, in generic EMIF areas of discussion, the prefix “A” or “B” may be omitted [e.g., the synchronous DRAM
memory access signals are shown as generic ( SDCAS, SDWE, and SDRAS ) instead of ASDCAS, ASDWE, and ASDRAS (for EMIFA) and
BSDCAS, BSDWE, and BSDRAS (for EMIFB)].
switching characteristics over recommended operating conditions for synchronous DRAM cycles
for EMIFA module
(see Figure 27
Figure 34)
NO.
PARAMETER
5E0
A
5E0
6E3
A
6E3
7E3
UNIT
MIN
1.3
MAX
6.4
6.4
MIN
1.3
MAX
4.9
4.9
1
2
3
4
5
8
9
10
11
12
13
t
d(EKO1H-CEV)
t
d(EKO1H-BEV)
t
d(EKO1H-BEIV)
t
d(EKO1H-EAV)
t
d(EKO1H-EAIV)
t
d(EKO1H-CASV)
t
d(EKO1H-EDV)
t
d(EKO1H-EDIV)
t
d(EKO1H-WEV)
t
d(EKO1H-RAS)
t
d(EKO1H-ACKEV)
t
d(EKO1H-PDTV)
Delay time, ECLKOUTx high to CEx valid
Delay time, ECLKOUTx high to BEx valid
Delay time, ECLKOUTx high to BEx invalid
Delay time, ECLKOUTx high to EAx valid
Delay time, ECLKOUTx high to EAx invalid
Delay time, ECLKOUTx high to SDCAS valid
Delay time, ECLKOUTx high to EDx valid
Delay time, ECLKOUTx high to EDx invalid
Delay time, ECLKOUTx high to SDWE valid
Delay time, ECLKOUTx high to SDRAS valid
Delay time, ECLKOUTx high to ASDCKE valid (EMIFA only)
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
1.3
1.3
6.4
4.9
1.3
1.3
1.3
1.3
6.4
6.4
4.9
4.9
1.3
1.3
1.3
1.3
1.3
1.3
1.3
1.3
6.4
6.4
6.4
4.9
4.9
4.9
14
Delay time, ECLKOUTx high to PDT valid
1.3
6.4
1.3
4.9
ns
These C64x
devices have two EMIFs (EMIFA and EMIFB). All EMIFA signals are prefixed by an “A” and all EMIFB signals are prefixed by a
“B”. Throughout the rest of this document, in generic EMIF areas of discussion, the prefix “A” or “B” may be omitted [e.g., the synchronous DRAM
memory access signals are shown as generic ( SDCAS, SDWE, and SDRAS ) instead of ASDCAS, ASDWE, and ASDRAS (for EMIFA) and
BSDCAS, BSDWE, and BSDRAS (for EMIFB)].
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