
Figures
6
March 2004  Revised October 2004
SGUS051A
List of Figures
Figure
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21. 320F2812 and 320C2812 179-Ball GHH MicroStar BGA (Bottom View)
22. 320F2812 and 320C2812 176-Pin PGF LQFP (Top View)
23. 320F2810, 320F2811, 320C2810, and 320C2811 128-Pin PBK 
LQFP (Top View)
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31. Functional Block Diagram
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32. F2812/C2812 Memory Map 
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33. F2811/C2811 Memory Map
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34. F2810/C2810 Memory Map
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35. External Interface Block Diagram
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36. Interrupt Sources
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37. Multiplexing of Interrupts Using the PIE Block
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38. Clock and Reset Domains
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39. OSC and PLL Block
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310. Recommended Crystal/Clock Connection
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311. Watchdog Module
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41. CPU-Timers
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42. CPU-Timer Interrupts Signals and Output Signal 
43. Event Manager A Functional Block Diagram
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44. Block Diagram of the F281x and C281x ADC Module
45. ADC Pin Connections With Internal Reference 
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46. ADC Pin Connections With External Reference
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47. eCAN Block Diagram and Interface Circuit
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48. eCAN Memory Map
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49. McBSP Module With FIFO
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410. Serial Communications Interface (SCI) Module Block Diagram
411. Serial Peripheral Interface Module Block Diagram (Slave Mode)
412. Modes of Operation
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51. TMS320x28x Device Nomenclature
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61. FIT Rate vs Operating Junction Temperature
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62. Package Lifetime vs Operating Junction Temperature
63. F2812/F2811/F2810 Typical Current Consumption (With Peripheral Clocks Enabled)
64. F2812/F2811/F2810 Typical Power-Up and Power-Down Sequence  Option 2
65. Output Levels
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66. Input Levels
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67. 3.3-V Test Load Circuit
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68. Clock Timing
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69. Power-on Reset in Microcomputer Mode (XMP/MC = 0)
610. Power-on Reset in Microprocessor Mode (XMP/MC = 1)
611. Warm Reset in Microcomputer Mode
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612. Effect of Writing Into PLLCR Register
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613. IDLE Entry and Exit Timing
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