參數(shù)資料
型號： TMS320DM647_08
廠商： Texas Instruments, Inc.
英文描述： Digital Media Processor
中文描述： 數(shù)字媒體處理器
文件頁數(shù)： 40/167頁
文件大?。?/td> 1438K
代理商： TMS320DM647_08
www.ti.com
P
3.2.5
KEY_REG
TMS320DM647/TMS320DM648
Digital Media Processor
SPRS372A–MAY 2007–REVISED JUNE 2007
The Ethernet Subsystem and VLYNQ fields specify the priority of the Ethernet Switch Subsystem and
VLYNQ peripherals, respectively. Similarly, the HOST field applies to the priority of the HPI and PCI
peripherals. Other master peripherals are not present in the PRI_ALLOC register as they have their own
registers to program their priorities. For more information on the default priority values in these peripheral
registers, see the device-compatible peripheral reference guides.
TI recommends that these priority registers be reprogrammed upon initial use.
Table 3-5. Default Master Priorities
Default Priority
0 (EDMA CC QUEPRI Register)
0 (EDMA CC QUEPRI Register)
0 (EDMA CC QUEPRI Register)
0 (EDMA CC QUEPRI Register)
7 (C64x+ MDMAARBE.PRI Register bit field)
1 (C64x+ MDMAARBE.PRI Register bit field)
3 (PRI_ALLOC register)
4 (PRI_ALLOC register)
4 (PRI_ALLOC register)
4 (PRI_ALLOC register)
5 (PRI_ALLOC register)
Master
EDMA3TC0
EDMA3TC1
EDMA3TC2
EDMA3TC3
64x+_DMAP
64x+_CFGP
Ethernet Subsystem
VLYNQ
UHPI
PCI
VICP
Figure 3-4. Priority Allocation Register (PRI_ALLOC)
31
16
Reserved
R-0000000111001111
15
12
11
9
8
6
5
3
2
0
Reserved
VICP
VLYNQ
HOST
Ethernet Subsystem
R-0111
R/W-101
R/W-100
R/W-100
R/W-011
LEGEND: R/W = Read/Write; R = Read only; -
n
= value after reset
KEY_REG protects against accidental writes to certain system configuration registers. The complete set of
registers protected by the KEY_REG is:
PINMUX
BOOTCFG
PRI_ALLOC
CFGPLL
CFGRX0
CFGTX0
CFGRX1
CFGTX1
MAC_ADDR_RW0
MAC_ADDR_RW1
Writes to these registers are locked/blocked by default. To enable writes to these registers, write
0xADDDECAF to the KEY_REG. After enabling writes to protected registers by doing the above, the
register writes should occur within 10000 CPU/6 cycles, after which the key will be reset.
Device Configuration
40
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