參數(shù)資料
型號(hào)： TMS320C6424_1
廠商： Texas Instruments, Inc.
元件分類： 數(shù)字信號(hào)處理
英文描述： Fixed-Point Digital Signal Processor
中文描述： 定點(diǎn)數(shù)字信號(hào)處理器
文件頁數(shù)： 86/245頁
文件大?。?/td> 1823K
代理商： TMS320C6424_1
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www.ti.com
TMS320C6424
Fixed-Point Digital Signal Processor
SPRS347B–MARCH 2007–REVISED NOVEMBER 2007
Table 3-10. Default Functions Affected by Device Boot and Configuration Pins
DEVICE BOOT AND
CONFIGURATION PINS
BOOTMODE[3:0]
BOOT SELECTED
PIN MUX CONTROL
GLOBAL SETTING
PERIPHERAL SETTING
Boot Mode
PINMUX0/PINMUX1
Registers
:
Based on
BOOTMODE[3:0], the
bootloader code programs VDD3P3V_PWDN register the PSC to put
PINMUX0 and PINMUX1
to power up the I/O pins
registers to select the
required for boot.
appropriate pin functions
required for boot.
–
Sets Device Frequency
:
Based on BOOTMODE,
FASTBOOT, and PLLMS;
the bootloader code
programs PLLC1.
–
Sets Device Frequency
:
Based on BOOTMODE,
FASTBOOT, and PLLMS;
the bootloader code
programs PLLC1.
PINMUX0.AEM
:
–
Sets the default of this
field to control the EMIFA
Pinout Mode.
I/O Pin Power
:
Based on
BOOTMODE[3:0], the
bootloader code programs bootloader code programs
PSC/Peripherals
:
Based on
BOOTMODE[3:0], the
boot-related peripheral(s)
in the Enable State, and
programs the peripheral(s)
for boot operation.
–
FASTBOOT
Fastboot
PLLMS[2:0]
If FASTBOOT = 1, the
PLLMS[2:0] selects the
FASTBOOT PLL
Multiplier.
–
AEM[2:0]
–
PSC/EMIFA
:
The EMIFA module state
defaults to SwRstDisable
if AEM = 0; otherwise, the
EMIFA module state
defaults to Enable.
Affects the pin muxing in
EMIFA Sub-Block 0, 1,
and 3.
–
8_16
EMIFA Boot:
8_16 determines the
EMIFA CS2 Data Bus
Width.
–
EMIFA:
Sets default of register
field A1CR.ASIZE to
determine the default data
bus width for EMIFA CS2
space.
PCIEN
(1)
Host Boot
:
PCIEN selects the type of
Host Boot
(HPI Boot
or
PCI Boot)
PINMUX1.PCIEN
:
sets this field to control
the PCI pin muxing in
Host Block, PCI Data
Block, GPIO Block,
EMIFA Sub-Block 0 and
Sub-Block 3.
–
PSC/Peripheral
(Applicable to Host Boot
only)
:
Based on the Host Boot
type (PCI
or
HPI), the
bootloader code programs
the PSC to put the
corresponding peripheral
in the Enable State, and
programs the peripheral
for boot operation.
–
LENDIAN
–
–
Device endianess
(1)
(2)
Software can modify all PINMUX0 and PINMUX1 bit fields from their defaults,
except
for PINMUX1.PCIEN.
In addition to pin mux control, PCIEN also affects the internal pullup/down resistors of the PCI capable pins. When PCIEN = 0, internal
pullup/down resistors on the PCI capable pins are enabled. When PCIEN = 1, internal pullup/down resistors on the PCI capable pins are
disabled to be compliant to the
PCI Local Bus Specification Revision 2.3
.
For proper device operation, external pullup/pulldown resistors may be required on these device boot and
configuration pins. For discussion situations where external pullup/pulldown resistors are required, see
Section 3.9.1
,
Pullup/Pulldown Resistors
.
Note:
PLLMS[2:0], AEM[2:0], 8_16, and LENDIAN) are multiplexed with other functional pins. These pins
function as device boot and configuration pins only during device reset. The user
must
take care of any
potential data contention in the system. To help avoid system data contention, the C6424 puts these
configuration pins into a high-impedance state (Hi-Z) when device reset (RESET
or
POR) is asserted, and
continues to hold them in a high-impedance state until the internal global reset is removed; at which point,
the default peripheral (either GPIO
or
EMIFA based on default of AEM[2:0]) will now control these pins.
Except for PCIEN, all other C6424 configuration inputs (BOOTMODE[3:0], FASTBOOT,
Device Configurations
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