
List of Tables
v
February 2003—Revised January 2004
SLES068A
217 Multiple-Byte Read
24
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41 RESET During System Initialization
31
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42 Extending the I2C Write Interval Following Low-to-High Transition of RESET Terminal
32
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43 Changing the Data Sample Rate Using the DBSPD Terminal
33
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44 Changing the Data Sample Rate Using the I2C33
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45 Changing the Data Sample Rate With an Unstable MCLK_IN Using the DBSPD Terminal
34
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46 Changing the Data Sample Rate With an Unstable MCLK_IN Using the I2C35
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47 Changing Between Master and Slave Clock Modes
36
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51 RESET Timing
38
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52 Power-Down and Power-Up Timing—RESET Preceding PDN
39
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53 Power-Down and Power-Up Timing—RESET Following PDN
40
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54 Error Recovery Timing
41
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55 Mute Timing
41
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56 Right-Justified, I2S, Left-Justified Serial-Protocol Timing
42
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57 Right, Left, and I2S Serial-Mode Timing Requirement
43
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58 Serial Audio Ports Master-Mode Timing
43
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59 DSP Serial-Port Timing
43
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510 DSP Serial-Port Expanded Timing
44
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511 DSP Absolute Timing
44
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512 SCL and SDA Timing
45
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513 Start and Stop Conditions Timing
45
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61 Typical TAS5026A Application
47
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62 TAS5026A Serial Audio Port—Slave-Mode Connection Diagram
48
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63 TAS5026A Serial Audio Port—Master-Mode Connection Diagram
48
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List of Tables
Table
Title
Page
21 Normal-Speed, Double-Speed, and Quad-Speed Operation
8
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22 Master and Slave Clock Modes
10
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23 LRCLK and MCLK_IN Rates
10
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24 DCLK
11
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25 Supported Word Lengths
11
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26 Device Outputs During Reset
16
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27 Values Set During Reset
16
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28 Device Outputs During Power Down
16
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29 Volume Register
19
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210 De-Emphasis Filter Characteristics
20
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211 Device Outputs During Error Recovery
21
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31 I2C Register Map
25
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32 General Status Register (Read Only)
26
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33 Error Status Register
26
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34 System Control Register 0
26
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35 System Control Register 1
27
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36 Error Recovery Register
27
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