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參數(shù)資料
| 型號： | SX8725CWLTDT |
| 廠商： | Semtech |
| 文件頁數(shù)： | 67/68頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DAS ADC 16BIT I2C/SRL |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | ZoomingADC™ |
| 類型： | 數(shù)據(jù)采集系統(tǒng)（DAS） |
| 輸入類型： | 差分 |
| 輸出類型： | 數(shù)字 |
| 接口： | I²C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 12-WDFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 12-MLPD-EP（4x4） |
| 包裝： | 標(biāo)準(zhǔn)包裝 |
| 其它名稱： | SX8725CWLTDTDKR |
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www.semtech.com/products/
Page 8
ADVANCED COMMUNICATIONS & SENSING
DATASHEET
SX8725C
ZoomingADC for sensing data acquisition
Revision 1.01
January 2011
Semtech
(12)
Conversion time is given by: TCONV = (NELCONV (OSR + 1) + 1) / fS. OSR can be set between 8 and 1024, in powers of 2. NELCONV can be set to 1,
2, 4 or 8.
(13)
PGAs are reset after each writing operation to registers RegACCfg1-5, corresponding to change of configuration or input switching. The
ADC should be started only some delay after a change of PGA configuration through these registers. Delay between change of configura-
tion of PGA or input channel switching and ADC start should be equivalent to OSR (between 8 and 1024) number of cycles. This is done by
writing bit Start several cycles after PGA settings modification or channel switching. This delay does not apply to conversions made with-
out the PGAs.
(14)
Nominal (maximum) bias currents in PGAs and ADC, i.e. IbAmpPga[1:0] = '11' and IbAmpAdc[1:0] = '11'.
(15)
Bias currents in PGAs and ADC set to 3/4 of nominal values, i.e. IbAmpPga[1:0] = '10', IbAmpAdc[1:0] = '10'.
(16)
Bias currents in PGAs and ADC set to 1/2 of nominal values, i.e. IbAmpPga[1:0] = '01', IbAmpAdc[1:0] = '01'.
(17)
Bias currents in PGAs and ADC set to 1/4 of nominal values, i.e. IbAmpPga[1:0] = '00', IbAmpAdc[1:0] = '00'.
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