- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄382554 > ST90E158LV (意法半導體) 8/16-BIT MCU FAMILY WITH UP TO 64K ROM/OTP/EPROM AND UP TO 2K RAM PDF資料下載
參數(shù)資料
| 型號： | ST90E158LV |
| 廠商： | 意法半導體 |
| 英文描述： | 8/16-BIT MCU FAMILY WITH UP TO 64K ROM/OTP/EPROM AND UP TO 2K RAM |
| 中文描述： | 微控制器16位產(chǎn)品的家庭多達64K的ROM /檢察官/ EPROM和2K的內(nèi)存 |
| 文件頁數(shù)： | 110/190頁 |
| 文件大小： | 1152K |
| 代理商： | ST90E158LV |
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110/190
ST90158 - MULTIFUNCTION TIMER (MFT)
MULTIFUNCTION TIMER
(Cont’d)
9.2.3.9 TxINA = Clock Up - TxINB = Clock Down
The edge received on input pin A (or B) performs a
one step up (or down) count, so that the counter
clock and the up/downcontrol are external. Setting
the UDC bit in the TCR register has no effect in
this configuration, and input pin B has priority on
input pin A.
9.2.3.10 TxINA = Up/Down - TxINB = Ext Clock
An High (or Low) level applied to input pin A sets
the counter in the up (or down) count mode, while
the signal appliedto input pin Bis used as clock for
the prescaler. Setting the UDC bit in the TCR reg-
ister has no effect in this configuration.
9.2.3.11 TxINA = Trigger Up - TxINB = Trigger
Down
Up/down control is performed through both input
pins A and B. A edge on input pin A sets the up
count mode, while a edge on input pin B (which
has priority on input pin A) sets the down count
mode. The counter clock is internally generated,
and setting the UDC bit in the TCR registerhas no
effect in this configuration.
9.2.3.12 TxINA = Up/Down - TxINB = I/O
An High (or Low) level of the signal applied on in-
put pin Asets the counter inthe up (or down) count
mode. The counter clock is internally generated.
Setting the UDC bit in the TCR register has no ef-
fect in this configuration.
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相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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