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參數(shù)資料
| 型號(hào)： | ST7PLITE09Y0U6TR |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, QCC20 |
| 封裝： | QFN-20 |
| 文件頁數(shù)： | 3/123頁 |
| 文件大?。?/td> | 2176K |
| 代理商： | ST7PLITE09Y0U6TR |
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ST7LITE0x, ST7LITESx
100/123
13.9 CONTROL PIN CHARACTERISTICS
13.9.1 Asynchronous RESET Pin
TA = -40°C to 105°C, unless otherwise specified
Notes:
1. Data based on characterization results, not tested in production.
2. The IIO current sunk must always respect the absolute maximum rating specified in section 13.2.2 on page 82 and the
sum of IIO (I/O ports and control pins) must not exceed IVSS.
3. The RON pull-up equivalent resistor is based on a resistive transistor. Specified for voltages on RESET pin between
VILmax and VDD
4. To guarantee the reset of the device, a minimum pulse has to be applied to the RESET pin. All short pulses applied on
RESET pin with a duration below th(RSTL)in can be ignored.
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
VIL
Input low level voltage
VSS - 0.3
0.3xVDD
V
VIH
Input high level voltage
0.7xVDD
VDD + 0.3
Vhys
Schmitt trigger voltage hysteresis 1)
2V
VOL
Output low level voltage 2)
VDD=5V
IIO=+5mA TA≤85°C
TA≤105°C
0.5
1.0
1.2
V
IIO=+2mA TA≤85°C
TA≤105°C
0.2
0.4
0.5
RON
Pull-up equivalent resistor 3) 1)
VDD=5V
20
40
80
k
tw(RSTL)out Generated reset pulse duration
Internal reset sources
30
s
th(RSTL)in External reset pulse hold time
4)
20
s
tg(RSTL)in Filtered glitch duration
200
ns
1
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