- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄382552 > ST72F321 (意法半導體) 64/44-PIN 8-BIT MCU WITH 32 TO 60K FLASH/ROM, ADC, FIVE TIMERS, SPI, SCI, I2C INTERFACE PDF資料下載
參數(shù)資料
| 型號： | ST72F321 |
| 廠商： | 意法半導體 |
| 英文描述： | 64/44-PIN 8-BIT MCU WITH 32 TO 60K FLASH/ROM, ADC, FIVE TIMERS, SPI, SCI, I2C INTERFACE |
| 中文描述： | 64/44-PIN 8位微控制器32點，至60,000閃存/ ROM，ADC的，5個定時器，SPI和SCI的I2C接口 |
| 文件頁數(shù)： | 67/189頁 |
| 文件大?。?/td> | 3090K |
| 代理商： | ST72F321 |
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ST72321
67/189
PWM AUTO-RELOAD TIMER
(Cont’d)
INPUT CAPTURE
CONTROL / STATUS REGISTER (ARTICCSR)
Read/Write
Reset Value: 0000 0000 (00h)
Bit 7:6 = Reserved, always read as 0.
Bit 5:4 =
CS[2:1]
Capture Sensitivity
These bits are set and cleared by software. They
determine the trigger event polarity on the corre-
sponding input capture channel.
0: Falling edge triggers capture on channel x.
1: Rising edge triggers capture on channel x.
Bit 3:2 =
CIE[2:1]
Capture Interrupt Enable
These bits are set and cleared by software. They
enable or disable the Input capture channel inter-
rupts independently.
0: Input capture channel x interrupt disabled.
1: Input capture channel x interrupt enabled.
Bit 1:0 =
CF[2:1]
Capture Flag
These bits are set by hardware and cleared by
software reading the corresponding ARTICRx reg-
ister. Each CFx bit indicates that an input capture x
has occurred.
0: No input capture on channel x.
1: An input capture has occured on channel x.
INPUT CAPTURE REGISTERS (ARTICRx)
Read only
Reset Value: 0000 0000 (00h)
Bit 7:0 =
IC[7:0]
Input Capture Data
These read only bits are set and cleared by hard-
ware. An ARTICRx register contains the 8-bit
auto-reload counter value transferred by the input
capture channel x event.
7
0
0
0
CS2
CS1
CIE2
CIE1
CF2
CF1
7
0
IC7
IC6
IC5
IC4
IC3
IC2
IC1
IC0
相關PDF資料 |
PDF描述 |
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