- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄382552 > ST72F321 (意法半導(dǎo)體) 64/44-PIN 8-BIT MCU WITH 32 TO 60K FLASH/ROM, ADC, FIVE TIMERS, SPI, SCI, I2C INTERFACE PDF資料下載
參數(shù)資料
| 型號(hào)： | ST72F321 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | 64/44-PIN 8-BIT MCU WITH 32 TO 60K FLASH/ROM, ADC, FIVE TIMERS, SPI, SCI, I2C INTERFACE |
| 中文描述： | 64/44-PIN 8位微控制器32點(diǎn)，至60,000閃存/ ROM，ADC的，5個(gè)定時(shí)器，SPI和SCI的I2C接口 |
| 文件頁數(shù)： | 120/189頁 |
| 文件大?。?/td> | 3090K |
| 代理商： | ST72F321 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁第113頁第114頁第115頁第116頁第117頁第118頁第119頁當(dāng)前第120頁第121頁第122頁第123頁第124頁第125頁第126頁第127頁第128頁第129頁第130頁第131頁第132頁第133頁第134頁第135頁第136頁第137頁第138頁第139頁第140頁第141頁第142頁第143頁第144頁第145頁第146頁第147頁第148頁第149頁第150頁第151頁第152頁第153頁第154頁第155頁第156頁第157頁第158頁第159頁第160頁第161頁第162頁第163頁第164頁第165頁第166頁第167頁第168頁第169頁第170頁第171頁第172頁第173頁第174頁第175頁第176頁第177頁第178頁第179頁第180頁第181頁第182頁第183頁第184頁第185頁第186頁第187頁第188頁第189頁
ST72321
120/189
I
2
C BUS INTERFACE
(Cont’d)
Figure 67. Transfer Sequencing
7-bit Slave receiver:
Legend:
S=Start, S
r
= Repeated Start, P=Stop, A=Acknowledge, NA=Non-acknowledge,
EVx=Event (with interrupt if ITE=1)
EV1:
EVF=1, ADSL=1, cleared by reading SR1 register.
EV2:
EVF=1, BTF=1, cleared by reading SR1 register followed by reading DR register.
EV3:
EVF=1, BTF=1, cleared by reading SR1 register followed by writing DR register.
EV3-1:
EVF=1, AF=1, BTF=1; AF is cleared by reading SR1 register. BTF is cleared by releasing the
lines (STOP=1, STOP=0) or by writing DR register (DR=FFh).
Note:
If lines are released by
STOP=1, STOP=0, the subsequent EV4 is not seen.
EV4:
EVF=1, STOPF=1, cleared by reading SR2 register.
EV5:
EVF=1, SB=1, cleared by reading SR1 register followed by writing DR register.
EV6:
EVF=1, cleared by reading SR1 register followed by writing CR register (for example PE=1).
EV7:
EVF=1, BTF=1, cleared by reading SR1 register followed by reading DR register.
EV8:
EVF=1, BTF=1, cleared by reading SR1 register followed by writing DR register.
EV9:
EVF=1, ADD10=1, cleared by reading SR1 register followed by writing DR register.
7-bit Slave transmitter:
7-bit Master receiver:
7-bit Master transmitter:
10-bit Slave receiver:
10-bit Slave transmitter:
10-bit
Master transmitter
10-bit
Master receiver:
S Address
A
Data1
A
Data2
A
.....
DataN
A
P
EV1
EV2
EV2
EV2
EV4
S Address
A
Data1
A
Data2
A
.....
DataN
NA
P
EV1 EV3
EV3
EV3
EV3-1
EV4
S
Address
A
Data1
A
Data2
A
.....
DataN
NA
P
EV5
EV6
EV7
EV7
EV7
S
Address
A
Data1
A
Data2
A
.....
DataN
A
P
EV5
EV6 EV8
EV8
EV8
EV8
S Header
A
Address
A
Data1
A
.....
DataN
A
P
EV1
EV2
EV2
EV4
S
r
Header
A
Data1
A
....
.
DataN
A
P
EV1 EV3
EV3
EV3-1
EV4
S
Header
A
Address
A
Data1
A
.....
DataN
A
P
EV5
EV9
EV6 EV8
EV8
EV8
S
r
Header
A
Data1
A
.....
DataN
A
P
EV5
EV6
EV7
EV7
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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| ST72F321AR6TC | 制造商:STMicroelectronics 功能描述: |
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