參數(shù)資料
型號： SSTUAF32866CHLFT
廠商： IDT, Integrated Device Technology Inc
文件頁數(shù)： 6/30頁
文件大小： 0K
描述： IC REGIST BUFF 25BIT DDR2 96-BGA
標準包裝： 2,500
邏輯類型： 1:2 可配置寄存緩沖器
電源電壓： 1.7 V ~ 1.9 V
位數(shù)： 25，14
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 96-LFBGA
供應(yīng)商設(shè)備封裝： 96-CABGA（13.5x5.5）
包裝： 帶卷 (TR)
ICSSSTUAF32866C
25-BIT CONFIGURABLE REGISTERED BUFFER FOR DDR2
COMMERCIAL TEMPERATURE GRADE
25-BIT CONFIGURABLE REGISTERED BUFFER FOR DDR2
14
ICSSSTUAF32866C
7100/12
DC Electrical Characteristics Over Operating Range
Following Conditions Apply Unless Otherwise Specified:
Operating Condition: TA = 0°C to +70°C, VDD = 1.7V to 1.9V.
Symbol
Parameter
Test Conditions
Min.
Typ.
Max.
Units
VIK
II = -18mA
-1.2
V
VOH
Output HIGH Voltage
IOH = -6mA
1.2
V
VOL
Output LOW Voltage
IOL = 6mA
0.5
V
VERROL
QERR Output LOW
Voltage
IERROL = 25mA, VDD = 1.7V
0.5
V
IIL
All Inputs
VI = VDD or GND; VDD = 1.9V
-5
+5
A
IDD
Static Standby
IO = 0, VDD = 1.9V, RESET = GND
100
A
Static Operating
IO = 0, VDD = 1.9V, RESET = VDD, VI =
VIH(AC) or VIL(AC), CLK = CLK =
VIH(AC) or VIL(AC)
10
mA
IO = 0, VDD = 1.9V, RESET = VDD, VI =
VIH(AC) or VIL(AC), CLK = VIH(AC), CLK
= VIL(AC)
100
IDDD
Dynamic Operating
(clock only)
IO = 0, VDD = 1.8V, RESET = VDD, VI =
VIH(AC) or VIL(AC), CLK and CLK
switching 50% duty cycle
210
A/Clock
MHz
Dynamic Operating
(per each data input)
IO = 0, VDD = 1.8V, RESET =
VDD, VI = VIH(AC) or VIL(AC),
CLK and CLK switching 50%
duty cycle. One data input
switching at half clock
frequency, 50% duty cycle.
1:1
mode
70
A/Clock
MHz/
Data
Input
1:2
mode
120
CIN
Data Inputs
VI = VREF ± 350mV
2
3
pF
CLK and CLK
VICR = 1.25V, VIPP = 360mV
2
3
RESET
VI = VDD or GND
5
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PDF描述
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參數(shù)描述
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