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參數(shù)資料
| 型號(hào)： | SM320C6701S16 |
| 廠商： | Texas Instruments, Inc. |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | FLOATING-POINT DIGITAL SIGNAL PROCESSOR |
| 中文描述： | 浮點(diǎn)數(shù)字信號(hào)處理器 |
| 文件頁數(shù)： | 34/64頁 |
| 文件大?。?/td> | 939K |
| 代理商： | SM320C6701S16 |
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SGUS030B
–
APRIL 2000
–
REVISED MAY 2001
34
POST OFFICE BOX 1443
HOUSTON, TEXAS 77251
–
1443
SYNCHRONOUS-BURST MEMORY TIMING
timing requirements for synchronous-burst SRAM cycles (full-rate SSCLK)
(see Figure 14)
NO.
’
C6701-14
MIN
’
C6701-16
MIN
UNIT
MAX
MAX
7
tsu(EDV-SSCLKH)
th(SSCLKH-EDV)
Setup time, read EDx valid before SSCLK high
2.6
2.5
ns
8
Hold time, read EDx valid after SSCLK high
1.5
1.5
ns
switching characteristics for synchronous-burst SRAM cycles
(full-rate SSCLK)
(see Figure 14 and Figure 15)
NO.
PARAMETER
’
C6701-14
MIN
’
C6701-16
MIN
UNIT
MAX
MAX
1
tosu(CEV-SSCLKH)
toh(SSCLKH-CEV)
tosu(BEV-SSCLKH)
toh(SSCLKH-BEIV)
tosu(EAV-SSCLKH)
toh(SSCLKH-EAIV)
tosu(ADSV-SSCLKH)
toh(SSCLKH-ADSV)
tosu(OEV-SSCLKH)
toh(SSCLKH-OEV)
tosu(EDV-SSCLKH)
toh(SSCLKH-EDIV)
tosu(WEV-SSCLKH)
toh(SSCLKH-WEV)
The effects of internal clock jitter are included at test. There is no need to adjust timing numbers for internal clock jitter.
When the PLL is used (CLKMODE x4), P = 1/CPU clock frequency in ns. For example, when running parts at 167 MHz, use P = 6 ns.
For CLKMODE x1, 0.5P is defined as PH (pulse duration of CLKIN high) for all output setup times; 0.5P is defined as PL (pulse duration of CLKIN
low) for all output hold times.
Output setup time, CEx valid before SSCLK high
0.5P
–
1.5
0.5P
–
1.3
ns
2
Output hold time, CEx valid after SSCLK high
0.5P
–
2.5
0.5P
–
2.3
ns
3
Output setup time, BEx valid before SSCLK high
0.5P
–
1.6
0.5P
–
1.6
ns
4
Output hold time, BEx invalid after SSCLK high
0.5P
–
2.5
0.5P
–
2.3
ns
5
Output setup time, EAx valid before SSCLK high
0.5P
–
1.7
0.5P
–
1.7
ns
6
Output hold time, EAx invalid after SSCLK high
0.5P
–
2.5
0.5P
–
2.5
ns
9
Output setup time, SSADS valid before SSCLK high
0.5P
–
1.5
0.5P
–
1.3
ns
10
Output hold time, SSADS valid after SSCLK high
0.5P
–
2.5
0.5P
–
2.3
ns
11
Output setup time, SSOE valid before SSCLK high
0.5P
–
1.5
0.5P
–
1.3
ns
12
Output hold time, SSOE valid after SSCLK high
0.5P
–
2.5
0.5P
–
2.5
ns
13
Output setup time, EDx valid before SSCLK high
0.5P
–
1.5
0.5P
–
1.3
ns
14
Output hold time, EDx invalid after SSCLK high
0.5P
–
2.5
0.5P
–
2.5
ns
15
Output setup time, SSWE valid before SSCLK high
0.5P
–
1.5
0.5P
–
1.3
ns
16
Output hold time, SSWE valid after SSCLK high
0.5P
–
2.5
0.5P
–
2.3
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| SM320C6201BS14 | FLOATING-POINT DIGITAL SIGNAL PROCESSOR |
| SM320C6201BS16 | FLOATING-POINT DIGITAL SIGNAL PROCESSOR |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| SM320C6701W16 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:FLOATING-POINT DIGITAL SIGNAL PROCESSOR |
| SM320C6701ZMBW14 | 功能描述:數(shù)字信號(hào)處理器和控制器 - DSP, DSC Floating Point Dig Signal Proc Military RoHS:否 制造商:Microchip Technology 核心:dsPIC 數(shù)據(jù)總線寬度:16 bit 程序存儲(chǔ)器大小:16 KB 數(shù)據(jù) RAM 大小:2 KB 最大時(shí)鐘頻率:40 MHz 可編程輸入/輸出端數(shù)量:35 定時(shí)器數(shù)量:3 設(shè)備每秒兆指令數(shù):50 MIPs 工作電源電壓:3.3 V 最大工作溫度:+ 85 C 封裝 / 箱體:TQFP-44 安裝風(fēng)格:SMD/SMT |
| SM320C6711B-EP | 制造商:TI 制造商全稱:Texas Instruments 功能描述:FLOATING-POINT DIGTAL SIGNAL PROCESSORS |
| SM320C6711C-EP | 制造商:TI 制造商全稱:Texas Instruments 功能描述:FLOATING-POINT DIGTAL SIGNAL PROCESSORS |
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