參數(shù)資料
型號： SL28506BZIT
廠商： SILICON LABORATORIES
元件分類： 時鐘產(chǎn)生/分配
英文描述： 400 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO64
封裝： 6 X 17 MM, HALOGEN FREE AND ROHS COMPLIANT, MO-153EF, TSSOP-64
文件頁數(shù)： 25/28頁
文件大?。?/td> 261K
代理商： SL28506BZIT
SL28506
.........................DOC #: SP-AP-0021 (Rev AA) Page 6 of 28
Control Registers
Byte 0: Control Register 0
Bit
@Pup
Name
Description
7
HW
FS_C
CPU Frequency Select Bit, set by HW
6
HW
FS_B
CPU Frequency Select Bit, set by HW
5
HW
FS_A
CPU Frequency Select Bit, set by HW
4
0
iAMT_EN
Set via SMBus or by combination of PWRDWN, CPU_STP, and PCI_STP
0 = Legacy Mode, 1 = iAMT Enabled, Sticky 1
3
0
RESERVED
2
0
SRC_MAIN_SEL
Select source for SRC clock,
0 = SRC_MAIN = PLL1, PLL3_CFB Table applies
1 = SRC_MAIN = PLL3, PLL3_CFB Table does not apply
1
0
SATA_SEL
Select source of SATA clock
0 = SATA SRC_MAIN, 1= SATA PLL2
0
1
PD_Restore
Save Config. In powerdown
0 = Config. Cleared, 1 = Config. Saved
Byte 1: Control Register 1
Bit
@Pup
Name
Description
7
0
SRC0_SEL
Select for SRC0 or DOT96, 0 = SRC0, 1 = DOT96
6
0
PLL1_SS_DC
Select for down or center SS,
0 = Down spread, 1 = Center spread
5
0
PLL3_SS_DC
Select for down or center SS,
0 = Down spread, 1 = Center spread
4
0
PLL3_CFB3
Bit 4:1 only apply when SRC_SEL=0
0000 = PLL3 Disable Default
PLL3 OFF, SRC1 = SRC_MAIN
0001 = 100 MHz 0.5% SSC Stby
PLL3 ON, SRC1 = SRC_MAIN
0010 = 100 MHz 0.5% SSC
Only SRC1 sourced from PLL3
0011 = 100 MHz 1.0% SSC
Only SRC1 sourced from PLL3
0100 = 100 MHz 1.5% SSC
Only SRC1 sourced from PLL3
0101 = 100 MHz 2.0% SSC
Only SRC1 sourced from PLL3
0110 = RESERVED
Note: SE clocks required to be
0111 = RESERVED
enabled through Byte 8 Bit[1:0]
1000 = 1394A(24.576M) on SE1 and SE2
1001 = 1394A(24.576M) on SE1 and 1394B (98.304M) on SE2
1010 = 1394B on SE1 and SE2
1011 = 27MHz_NSS on SE1 and SE2
1100 = 25MHz on SE1 and SE2
1101 = 25MHz on SE1 and SE2 Disabled (set whenPCI3/CFB0 is set high to
config to HW mode 3)
1110 = RESERVED
1111 = RESERVED
3
0
PLL3_CFB2
2
0
PLL3_CFB1
1
PLL3_CFB0
0
1
PCI_SEL
Select PCI Clock source from PLL1 or SRC_MAIN
0 = PLL1, 1 = SRC_MAIN
Byte 2: Control Register 2
Bit
@Pup
Name
Description
7
1
REF_OE
Output enable for REF
0 = Output Disabled, 1 = Output Enabled
6
1
USB_OE
Output enable for USB
0 = Output Disabled, 1 = Output Enabled
相關PDF資料
PDF描述
SL28548ALC-2T PROC SPECIFIC CLOCK GENERATOR, QCC64
SL28610BLC 100 MHz, PROC SPECIFIC CLOCK GENERATOR, QCC48
SL28647CLCT 400 MHz, PROC SPECIFIC CLOCK GENERATOR, QCC72
SL28779CLCT 133 MHz, PROC SPECIFIC CLOCK GENERATOR, QCC32
SL28PCIE26ALIT OTHER CLOCK GENERATOR, QCC32
相關代理商/技術參數(shù)
參數(shù)描述
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