(VDD = 1.8 ± 5%, 2.5 ±10%, T
參數(shù)資料
型號: SI5374B-A-GL
廠商: Silicon Laboratories Inc
文件頁數(shù): 45/69頁
文件大?。?/td> 0K
描述: IC CLK GEN/JITTER ATTEN 80LBGA
標準包裝: 240
系列: DSPLL®
類型: 時鐘發(fā)生器,漂移衰減器
PLL:
輸入: 時鐘
輸出: CML,CMOS,LVDS,LVPECL
電路數(shù): 1
比率 - 輸入:輸出: 8:8
差分 - 輸入:輸出: 是/是
頻率 - 最大: 808MHz
除法器/乘法器: 是/是
電源電壓: 1.71 V ~ 2.75 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 80-LBGA
供應商設備封裝: 80-BGA(10x10)
包裝: 托盤
其它名稱: 336-2046
Si5374
Rev. 1.1
5
Table 2. DC Characteristics
(VDD = 1.8 ± 5%, 2.5 ±10%, TA = –40 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
Supply Current1
IDD
LVPECL Format
622.08 MHz Out
All CKOUTs Enabled
1000
1100
mA
LVPECL Format
622.08 MHz Out
4 CKOUTs Enabled
—870
970
mA
CMOS Format
19.44 MHz Out
All CKOUTs Enabled
—820
940
mA
CMOS Format
19.44 MHz Out
4 CKOUTs Enabled
—780
880
mA
Disable Mode
660
mA
CKINn Input Pins2
Input Common Mode
Voltage (Input Thresh-
old Voltage)
VICM
1.8 V ± 5%
0.9
1.4
V
2.5 V ± 10%
1
1.7
V
Input Resistance
CKNRIN
Single-ended
20
40
60
k
Single-Ended Input
Voltage Swing
(See Absolute Specs)
VISE
fCKIN < 212.5 MHz
0.2
VPP
fCKIN > 212.5 MHz
0.25
VPP
Differential Input
Voltage Swing
(See Absolute Specs)
VID
fCKIN < 212.5 MHz
0.2
VPP
fCKIN > 212.5 MHz
0.25
VPP
Output Clocks (CKOUTn)3,4
Common Mode
CKOVCM
LVPECL 100
load
line-to-line
VDD
1.42
—VDD –1.25
V
Differential Output
Swing
CKOVD
LVPECL 100
load
line-to-line
1.1
1.9
VPP
Notes:
1.
Current draw is independent of supply voltage.
2.
No under- or overshoot is allowed.
3.
LVPECL outputs require nominal VDD =2.5 V.
4.
LVPECL, CML, LVDS and low-swing LVDS measured with Fo = 622.08 MHz.
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