tDC SCLK = 10 MHz 40 — 60 % Cycle Time, SCLK
參數(shù)資料
型號： SI5369C-C-GQ
廠商： Silicon Laboratories Inc
文件頁數(shù)： 5/84頁
文件大?。?/td> 0K
描述： IC CLK MULT JITTER ATTEN 100TQFP
標(biāo)準包裝： 90
系列： DSPLL®
類型： *
PLL： 是
輸入： LVCMOS
輸出： CML，CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 4:5
差分 - 輸入:輸出： 是/是
頻率 - 最大： 346MHz
除法器/乘法器： 是/是
電源電壓： 1.71 V ~ 3.63 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 100-TQFP
供應(yīng)商設(shè)備封裝： 100-TQFP（14x14）
包裝： 托盤
Si5369
Rev. 1.0
13
SPI Specifications
Duty Cycle, SCLK
tDC
SCLK = 10 MHz
40
—
60
%
Cycle Time, SCLK
tc
100
—
ns
Rise Time, SCLK
tr
20–80%
—
25
ns
Fall Time, SCLK
tf
20–80%
—
25
ns
Low Time, SCLK
tlsc
20–20%
30
—
ns
High Time, SCLK
thsc
80–80%
30
—
ns
Delay Time, SCLK Fall
to SDO Active
td1
——
25
ns
Delay Time, SCLK Fall
to SDO Transition
td2
——
25
ns
Delay Time, SS Rise
to SDO Tri-state
td3
——
25
ns
Setup Time, SS to
SCLK Fall
tsu1
25
—
ns
Hold Time, SS to
SCLK Rise
th1
20
—
ns
Setup Time, SDI to
SCLK Rise
tsu2
25
—
ns
Hold Time, SDI to
SCLK Rise
th2
20
—
ns
Delay Time between
Slave Selects
tcs
25
—
ns
Table 4. Microprocessor Control (Continued)
(VDD = 1.8 ± 5%, 2.5 ±10%, or 3.3 V ±10%, TA = –40 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
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PDF描述
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參數(shù)描述
SI5369C-C-GQR 功能描述:時鐘發(fā)生器及支持產(chǎn)品 Lo Loop BW Clk Multi Jitter Attn 4In/5Out RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56
Si5369D-C-GQ 功能描述:時鐘發(fā)生器及支持產(chǎn)品 LW LOOP BW AR CLK MULT/JITTER 4IN 5OUT RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56
SI5369D-C-GQR 功能描述:時鐘發(fā)生器及支持產(chǎn)品 Lo Loop BW Clk Multi Jitter Attn 4In/5Out RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56
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