tDC SCLK = 10 MHz 40 — 60 % Cycle Time, SCLK
參數(shù)資料
型號: SI5326A-C-GM
廠商: Silicon Laboratories Inc
文件頁數(shù): 2/72頁
文件大?。?/td> 0K
描述: IC ANY-RATE MULTI/ATTEN 36-QFN
標準包裝: 490
系列: DSPLL®
類型: 時鐘放大器,振動衰減器
PLL:
輸入: 時鐘
輸出: CML,CMOS,LVDS,LVPECL
電路數(shù): 1
比率 - 輸入:輸出: 2:2
差分 - 輸入:輸出: 是/是
頻率 - 最大: 1.4GHz
除法器/乘法器: 是/是
電源電壓: 1.71 V ~ 3.63 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 36-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝: 36-QFN(6x6)
包裝: 托盤
Si5326
10
Rev. 1.0
SPI Specifications
Duty Cycle, SCLK
tDC
SCLK = 10 MHz
40
60
%
Cycle Time, SCLK
tc
100
ns
Rise Time, SCLK
tr
20–80%
25
ns
Fall Time, SCLK
tf
20–80%
25
ns
Low Time, SCLK
tlsc
20–20%
30
ns
High Time, SCLK
thsc
80–80%
30
ns
Delay Time, SCLK Fall
to SDO Active
td1
——
25
ns
Delay Time, SCLK Fall
to SDO Transition
td2
——
25
ns
Delay Time, SS Rise
to SDO Tri-state
td3
——
25
ns
Setup Time, SS to
SCLK Fall
tsu1
25
ns
Hold Time, SS to
SCLK Rise
th1
20
ns
Setup Time, SDI to
SCLK Rise
tsu2
25
ns
Hold Time, SDI to
SCLK Rise
th2
20
ns
Delay Time between
Slave Selects
tcs
25
ns
Table 3. Microprocessor Control (Continued)
(VDD = 1.8 ± 5%, 2.5 ±10%, or 3.3 V ±10%, TA = –40 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
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參數(shù)描述
SI5326A-C-GMR 功能描述:時鐘合成器/抖動清除器 Precision Clk Xplier Jitter Attn 2In/Out RoHS:否 制造商:Skyworks Solutions, Inc. 輸出端數(shù)量: 輸出電平: 最大輸出頻率: 輸入電平: 最大輸入頻率:6.1 GHz 電源電壓-最大:3.3 V 電源電壓-最小:2.7 V 封裝 / 箱體:TSSOP-28 封裝:Reel
Si5326B-B-GM 功能描述:鎖相環(huán) - PLL ANY-RATE CLK MULT JITTER ATTEN 2 OUTS RoHS:否 制造商:Silicon Labs 類型:PLL Clock Multiplier 電路數(shù)量:1 最大輸入頻率:710 MHz 最小輸入頻率:0.002 MHz 輸出頻率范圍:0.002 MHz to 808 MHz 電源電壓-最大:3.63 V 電源電壓-最小:1.71 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:QFN-36 封裝:Tray
SI5326B-B-GMR 制造商:Silicon Laboratories Inc 功能描述:
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