參數(shù)資料
型號(hào): SI5010-B-GM
廠商: Silicon Laboratories Inc
文件頁數(shù): 4/20頁
文件大?。?/td> 0K
描述: IC CLOCK/DATA RECOVERY LP 20-QFN
標(biāo)準(zhǔn)包裝: 75
系列: DSPLL®
類型: 時(shí)鐘和數(shù)據(jù)恢復(fù)(CDR)
PLL:
主要目的: SONET/SDH,ATM 應(yīng)用
輸入: 時(shí)鐘
輸出: CML
電路數(shù): 1
比率 - 輸入:輸出: 1:2
差分 - 輸入:輸出: 是/是
頻率 - 最大: 666MHz
電源電壓: 2.375 V ~ 2.625 V
工作溫度: -40°C ~ 85°C
安裝類型: 表面貼裝
封裝/外殼: 20-VFQFN 裸露焊盤
供應(yīng)商設(shè)備封裝: 20-QFN(4x4)
包裝: 管件
產(chǎn)品目錄頁面: 628 (CN2011-ZH PDF)
其它名稱: 336-1743-5
Si5010
12
Rev. 1.4
4.10. Differential Input Circuitry
The Si5010 provides differential inputs for both the high-speed data (DIN) and the reference clock (REFCLK)
inputs. An example termination for these inputs is shown in Figure 6. In applications where direct dc coupling is
possible, the 0.1 F capacitors may be omitted. The DIN and REFCLK input amplifiers require an input signal with
a minimum differential peak-to-peak voltage listed in Table 2 on page 6.
Figure 6. Input Termination for DIN and REFCLK (AC Coupled)
Figure 7. Single-Ended Input Termination for REFCLK (AC Coupled)
Figure 8. Single-Ended Input Termination for DIN (AC Coupled)
Differential
Driver
Si5010
0.1 F
Zo = 50
Zo = 50
DIN+,
REFCLK+
DIN–,
REFCLK–
2.5 k
2.5 k
10 k
10 k
102
VDD
GND
0.1 F
0.1
μF
Clock
source
Si5010
0.1
μF
Zo = 50
Ω
REFCLK +
REFCLK –
2.5 k
Ω
2.5 k
Ω
10 k
Ω
10 k
Ω
100
Ω
GND
VDD
102
Ω
0.1
μF
Clock
source
Si5010
0.1
μF
Zo = 50
Ω
DIN +
DIN –
2.5 k
Ω
2.5 k
Ω
10 k
Ω
10 k
Ω
100
Ω
GND
VDD
102
Ω
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PDF描述
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SI5010-EVB 功能描述:時(shí)鐘和定時(shí)器開發(fā)工具 SONET/SDH 2.5 V OC-3/12 STM-1/4 RoHS:否 制造商:Texas Instruments 產(chǎn)品:Evaluation Modules 類型:Clock Conditioners 工具用于評(píng)估:LMK04100B 頻率:122.8 MHz 工作電源電壓:3.3 V
SI5010-GM 制造商:SILABS 制造商全稱:SILABS 功能描述:OC-12/3, STM-4/1 SONET/SDH CLOCK AND DATA RECOVERY IC