參數(shù)資料
型號： SC16C550BIB48,157
廠商： NXP Semiconductors
文件頁數(shù)： 7/48頁
文件大小： 0K
描述： IC UART SINGLE W/FIFO 48-LQFP
標(biāo)準(zhǔn)包裝： 1,250
特點(diǎn)： 可編程
通道數(shù)： 1，UART
FIFO's： 16 字節(jié)
電源電壓： 2.5V，3.3V，5V
帶自動流量控制功能： 是
帶故障啟動位檢測功能： 是
帶調(diào)制解調(diào)器控制功能： 是
帶CMOS： 是
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP（7x7）
包裝： 管件
其它名稱： 935274388157
SC16C550BIB48
SC16C550BIB48-ND
SC16C550B_5
NXP B.V. 2008. All rights reserved.
Product data sheet
Rev. 05 — 1 October 2008
15 of 48
NXP Semiconductors
SC16C550B
5 V, 3.3 V and 2.5 V UART with 16-byte FIFOs
6.6 DMA operation
The SC16C550B FIFO trigger level provides additional exibility to the user for block
mode operation. The user can optionally operate the transmit and receive FIFOs in the
DMA mode (FCR[3]). The DMA mode affects the state of the RXRDY and TXRDY output
pins. Table 7 and Table 8 show this.
Remark: DMA operation is not supported in the HVQFN32 package.
Table 6.
Baud rates using 1.8432 MHz or 3.072 MHz crystal
Using 1.8432 MHz crystal
Using 3.072 MHz crystal
Desired baud
rate
Divisor for
16
× clock
Baud rate
error
Desired baud
rate
Divisor for
16
× clock
Baud rate
error
50
2304
50
3840
75
1536
75
2560
110
1047
0.026
110
1745
0.026
134.5
857
0.058
134.5
1428
0.034
150
768
150
1280
300
384
300
640
600
192
600
320
1200
96
1200
160
1800
64
1800
107
0.312
2000
58
0.69
2000
96
2400
48
2400
80
3600
32
3600
53
0.628
4800
24
4800
40
7200
16
7200
27
1.23
9600
12
9600
20
19200
6
19200
10
38400
3
38400
5
56000
2
2.86
Table 7.
Effect of DMA mode on state of RXRDY pin
Non-DMA mode
DMA mode
1 = FIFO empty
0-to-1 transition when FIFO empties
0 = at least 1 byte in FIFO
1-to-0 transition when FIFO reaches trigger level,
or time-out occurs
Table 8.
Effect of DMA mode on state of TXRDY pin
Non-DMA mode
DMA mode
1 = at least 1 byte in FIFO
1 = FIFO is full
0 = FIFO empty
0 = FIFO is empty
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PDF描述
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參數(shù)描述
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