參數(shù)資料
型號: SAK-XC2267M-104F80LAA
廠商: INFINEON TECHNOLOGIES AG
元件分類: 微控制器/微處理器
英文描述: 32-BIT, FLASH, 80 MHz, RISC MICROCONTROLLER, PQFP100
封裝: 0.50 MM PITCH, GREEN, PLASTIC, LQFP-100
文件頁數(shù): 23/129頁
文件大小: 1131K
代理商: SAK-XC2267M-104F80LAA
XC2268M/67M, XC2265M/64M/63M
XC2000 Family Derivatives / Base Line
Electrical Parameters
Data Sheet
119
V2.0, 2009-03
4.6.7
Debug Interface Timing
The debugger can communicate with the XC226xM either via the 2-pin DAP interface or
via the standard JTAG interface.
Debug via JTAG
The following parameters are applicable for communication through the JTAG debug
interface. The JTAG module is fully compliant with IEEE1149.1-2000.
Note: These parameters are not subject to production test but verified by design and/or
characterization.
Note: Operating Conditions apply.
Table 35
JTAG Interface Timing Parameters for Upper Voltage Range
Parameter
Symbol
Values
Unit Note /
Test Condition
Min.
Typ.
Max.
TCK clock period
t
1 SR
50
––ns
1)
1) Under typical conditions, the JTAG interface can operate at transfer rates up to 20 MHz.
TCK high time
t
2 SR
16
––ns
TCK low time
t
3 SR
16
––ns
TCK clock rise time
t
4 SR
–8ns
TCK clock fall time
t
5 SR
–8ns
TDI/TMS setup
to TCK rising edge
t
6 SR
6
––ns
TDI/TMS hold
after TCK rising edge
t
7 SR
6
––ns
TDO valid
after TCK falling edge2)
2) The falling edge on TCK is used to generate the TDO timing.
t
8 CC
2529ns
TDO high imped. to valid
from TCK falling edge2)3)
3) The setup time for TDO is given implicitly by the TCK cycle time.
t
9 CC
2529ns
TDO valid to high imped.
from TCK falling edge2)
t
10 CC
2529ns
TDO hold after
TCK falling edge2)
t
18 CC
5
––ns
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PDF描述
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SAK-XC2268N-40F80L AA 功能描述:IC MCU 16/32B 320KB FLSH 100LQFP RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微控制器, 系列:XC22xxN 標準包裝:330 系列:- 核心處理器:- 芯體尺寸:8/16-位 速度:40MHz 連通性:UART/USART 外圍設(shè)備:DMA,PWM,WDT 輸入/輸出數(shù):32 程序存儲器容量:- 程序存儲器類型:外部程序存儲器 EEPROM 大小:- RAM 容量:- 電壓 - 電源 (Vcc/Vdd):4.5 V ~ 5.5 V 數(shù)據(jù)轉(zhuǎn)換器:- 振蕩器型:內(nèi)部 工作溫度:-40°C ~ 85°C 封裝/外殼:100-BQFP 包裝:管件
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