參數(shù)資料
型號: S3C7559XX-QT
元件分類: 微控制器/微處理器
英文描述: 4-BIT, MROM, 6 MHz, MICROCONTROLLER, PQFP64
封裝: 14 X 20 MM, QFP-64
文件頁數(shù): 4/197頁
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代理商: S3C7559XX-QT
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INTERRUPTS
S3C7559/P7559
7-8
+
+ PROGRAMMING TIP — Setting the INT Interrupt Priority
The following instruction sequence sets the INT1 interrupt to high priority:
BITS
EMB
SMB
15
DI
; IPR.3 (IME)
← 0
LD
A,#3H
LD
IPR,A
EI
; IPR.3 (IME)
← 1
EXTERNAL INTERRUPT 0 and 1 MODE REGISTERS (IMOD0, IMOD1)
The following components are used to process external interrupts at the INT0 and INT1 pin:
— Noise filtering circuit for INT0
— Edge detection circuit
— Two mode registers, IMOD0 and IMOD1
The mode registers are used to control the triggering edge of the input signal. IMOD0 and IMOD1 settings let you
choose either the rising or falling edge of the incoming signal as the interrupt request trigger. The INT4 interrupt
is an exception since its input signal generates an interrupt request on both rising and falling edges.
FB4H
IMOD0.3
"0"
IMOD0.1
IMOD0.0
FB5H
"0"
IMOD1.0
IMOD0 and IMOD1 bits are addressable by 4-bit write instructions.
RESET clears all IMOD values to logic zero,
selecting rising edges as the trigger for incoming interrupt requests.
Table 7-5. IMOD0 and IMOD1 Register Organization
IMOD0
IMOD0.3
0
IMOD0.1
IMOD0.0
Effect of IMOD0 Settings
0
Select CPU clock for sampling
1
Select fxx/64 sampling clock
0
Rising edge detection
0
1
Falling edge detection
1
0
Both rising and falling edge detection
1
IRQ0 flag cannot be set to "1"
IMOD1
0
IMOD1.0
Effect of IMOD1 Settings
0
Rising edge detection
1
Falling edge detection
相關PDF資料
PDF描述
S3P7559-AT 4-BIT, OTPROM, 6 MHz, MICROCONTROLLER, PDIP64
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參數(shù)描述
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