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參數(shù)資料
| 型號： | R5F5630EDDFP#V0 |
| 廠商： | Renesas Electronics America |
| 文件頁數(shù)： | 44/165頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU RX630 2MB FLASH 100-LQFP |
| 產(chǎn)品培訓(xùn)模塊： | RX Compare Match Timer RX DMAC |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | RX600 |
| 核心處理器： | RX |
| 芯體尺寸： | 32-位 |
| 速度： | 100MHz |
| 連通性： | CAN，EBI/EMI，I²C，LIN，SCI，SPI，USB |
| 外圍設(shè)備： | DMA，LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 78 |
| 程序存儲器容量： | 2MB（2M x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 128K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b，14x12b，D/A 1x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-LQFP |
| 包裝： | 托盤 |
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R01DS0060EJ0100 Rev.1.00
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Sep 13, 2011
RX630 Group
5. Electrical Characteristics
Note 1. tPcyc: PCLK cycle
Table 5.17
Timing of On-Chip Peripheral Modules (3)
Conditions: VCC = AVCC0 = VCC_USB = 2.7 to 3.6 V, VREFH/VREFH0 = 2.7 V to AVCC0
VSS = AVSS0 = VREFL/VREFL0 = VSS_USB = 0 V
PCLK = 8 to 50 MHz
Ta = Topr
High drive output is selected by the drive capacity control register.
Item
Symbol
Min.
Max.
Unit*1
Test Conditions
Simple
SPI
SCK clock cycle output (master)
tSPcyc
4
65536
tPcyc
SCK clock cycle input (slave)
8
65536
SCK clock high pulse width
tSPCKWH
0.4
0.6
tSPcyc
SCK clock low pulse width
tSPCKWL
0.4
0.6
tSPcyc
SCK clock rise/fall time
tSPCKr, tSPCKf
—20
ns
Data input setup time
tSU
40
—
ns
Figure 5.33 to
Data input hold time
tH
40
—
ns
SS input setup time
tLEAD
1—
tSPcyc
SS input hold time
tLAG
1—
tSPcyc
Data output delay time
tOD
—40
ns
Data output hold time
tOH
10
—
ns
Data rise/fall time
tDr, tDf
—20
ns
SS input rise/fall time
tSSLr, tSSLf
—20
ns
Save access time
tSA
—5
tPcyc
Figure 5.35 and
Slave output release time
tREL
—5
tPcyc
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