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參數(shù)資料
| 型號： | R5F5630EDDFP#V0 |
| 廠商： | Renesas Electronics America |
| 文件頁數(shù)： | 37/165頁 |
| 文件大小： | 0K |
| 描述： | MCU RX630 2MB FLASH 100-LQFP |
| 產(chǎn)品培訓(xùn)模塊： | RX Compare Match Timer RX DMAC |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | RX600 |
| 核心處理器： | RX |
| 芯體尺寸： | 32-位 |
| 速度： | 100MHz |
| 連通性： | CAN，EBI/EMI，I²C，LIN，SCI，SPI，USB |
| 外圍設(shè)備： | DMA，LVD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 78 |
| 程序存儲器容量： | 2MB（2M x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 128K x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 3.6 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 8x10b，14x12b，D/A 1x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 100-LQFP |
| 包裝： | 托盤 |
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R01DS0060EJ0100 Rev.1.00
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Sep 13, 2011
RX630 Group
5. Electrical Characteristics
Figure 5.17
Address/Data Multiplexed Bus Read Access Timing
Figure 5.18
Address/Data Multiplexed Bus Write Access Timing
Address bus/
data bus
Data read
(RD#)
tAD
BCLK
Address bus
Address latch
(ALE)
Chip select
(CS1#)
tALED
TW1
TW2
Tn1
tAD
tRDS
Tn2
tRSD
TW3
TW4
TW5
Tend
Ta1
Tan
Address cycle
Data cycle
tRDH
tALED
tCSD
Address bus/
data bus
Data write
(WRm#)
tAD
BCLK
Address bus
Address latch
(ALE)
Chip select
(CS1#)
tALED
TW1
TW2
Tn1
tAD
Tn2
tWRD
TW3
TW4
TW5
Tend
Ta1
Tan
Address cycle
Data cycle
tALED
tCSD
tWDD
tWDH
Tn3
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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