參數(shù)資料
型號(hào)： PSD4256G6V-12UT
廠商： 意法半導(dǎo)體
英文描述： Flash In-System Programmable ISP Peripherals for 16-bit MCUs
中文描述： Flash在系統(tǒng)可編程ISP的周邊的16位微控制器
文件頁(yè)數(shù)： 92/100頁(yè)
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代理商： PSD4256G6V-12UT
PSD4256G6V
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Figure 47. Peripheral I/O READ Timing Diagram
Table 68. Port F Peripheral Data Mode READ Timing
Symbol
Parameter
Conditions
-10
Turbo
Off
Unit
Min
Max
t
AVQV–PF
Address Valid to Data Valid
(Note
3
)
50
+ 20
ns
t
SLQV–PF
CSI Valid to Data Valid
50
+ 20
ns
t
RLQV–PF
RD to Data Valid
(Notes
1,4
)
35
ns
RD to Data Valid 8031 Mode
45
ns
t
DVQV–PF
Data In to Data Out Valid
34
ns
t
QXRH–PF
RD Data Hold Time
0
ns
t
RLRH–PF
RD Pulse Width
(Note
1
)
35
ns
t
RHQZ–PF
RD to Data High-Z
(Note
1
)
38
ns
tQXRH (PF)
tRHQZ (PF)
tRLQV (PF)
tRLRH (PF)
tDVQV (PF)
tSLQV (PF)
tAVQV (PF)
ADDRESS
DATA VALID
ALE/AS
A/D BUS
RD
DATA ON PORT F
CSI
AI05740
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PDF描述
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