參數(shù)資料
型號： PSD4235G2V-70M
廠商： 意法半導體
英文描述： Flash In-System-Programmable Peripherals for 16-Bit MCUs
中文描述： Flash在系統(tǒng)可編程外設(shè)的16位微控制器
文件頁數(shù)： 38/89頁
文件大?。?/td> 702K
代理商： PSD4235G2V-70M
PSD4235G2V
38/89
Figure 16. Input Macrocell
External Chip Select.
The CPLD also provides
eight External Chip Select (ECS0-ECS7) outputs
that can be used to select external devices. Each
External Chip Select (ECS0-ECS7) consists of
one product term that can be configured active
High or Low.
The output enable of the pin is controlled by either
the output enable product term or the Direction
Register. (See Figure 17.)
Figure 17. External Chip Select Signal
OUTPUT
MACROCELLS A
AND
MACROCELLS B
PT
PT
FEEDBACK
A
P
PORT
DRIVER
I/O PIN
INTERNAL DATA BUS
DIRECTION
REGISTER
MUX
MUX
ALE/AS
PT
Q
Q
D
D
G
LATCH
INPUT MACROCELL
ENABLE (.OE)
D FF
INPUT MACROCELL_ RD
AI04926
P
POLARITY
BIT
PORT PIN
ECS PT
ECS
To Port C or F
ENABLE (.OE) PT
DIRECTION
REGISTER
C
Port C or Port F
AI04927
相關(guān)PDF資料
PDF描述
PSD4235G2V-70MI Flash In-System-Programmable Peripherals for 16-Bit MCUs
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PSD4256G6V-10UIT Flash In-System Programmable ISP Peripherals for 16-bit MCUs
PSD4256G6V-10UT Flash In-System Programmable ISP Peripherals for 16-bit MCUs
PSD4256G6V-12UIT Flash In-System Programmable ISP Peripherals for 16-bit MCUs
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參數(shù)描述
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