參數(shù)資料
型號(hào)： PIC17C766T-33E/L
元件分類： 微控制器/微處理器
英文描述： 8-BIT, OTPROM, 33 MHz, RISC MICROCONTROLLER, PQCC84
封裝： PLASTIC, MO-047, LCC-84
文件頁數(shù)： 279/303頁
文件大?。?/td> 5350K
代理商： PIC17C766T-33E/L
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2000 Microchip Technology Inc.
DS30289B-page 77
PIC17C7XX
TABLE 10-3:
PORTB FUNCTIONS
TABLE 10-4:
REGISTERS/BITS ASSOCIATED WITH PORTB
Name
Bit
Buffer Type
Function
RB0/CAP1
bit0
ST
Input/output or the Capture1 input pin. Software programmable weak
pull-up and interrupt-on-change features.
RB1/CAP2
bit1
ST
Input/output or the Capture2 input pin. Software programmable weak
pull-up and interrupt-on-change features.
RB2/PWM1
bit2
ST
Input/output or the PWM1 output pin. Software programmable weak pull-up
and interrupt-on-change features.
RB3/PWM2
bit3
ST
Input/output or the PWM2 output pin. Software programmable weak pull-up
and interrupt-on-change features.
RB4/TCLK12
bit4
ST
Input/output or the external clock input to Timer1 and Timer2. Software
programmable weak pull-up and interrupt-on-change features.
RB5/TCLK3
bit5
ST
Input/output or the external clock input to Timer3. Software programmable
weak pull-up and interrupt-on-change features.
RB6/SCK
bit6
ST
Input/output or the Master/Slave clock for the SPI. Software programmable
weak pull-up and interrupt-on-change features.
RB7/SDO
bit7
ST
Input/output or data output for the SPI. Software programmable weak
pull-up and interrupt-on-change features.
Legend: ST = Schmitt Trigger input
Address
Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Value on
POR,
BOR
MCLR,
WDT
12h, Bank 0
PORTB
RB7/
SDO
RB6/
SCK
RB5/
TCLK3
RB4/
TCLK12
RB3/
PWM2
RB2/
PWM1
RB1/
CAP2
RB0/
CAP1
xxxx xxxx
uuuu uuuu
11h, Bank 0
DDRB
Data Direction Register for PORTB
1111 1111
10h, Bank 0
PORTA
RBPU
—
RA5/
TX1/CK1
RA4/
RX1/DT1
RA3/
SDI/SDA
RA2/
SS/SCL
RA1/T0CKI
RA0/INT
0-xx 11xx
0-uu 11uu
06h, Unbanked
CPUSTA
—
STKAV
GLINTD
TO
PD
POR
BOR
--11 11qq
--11 qquu
07h, Unbanked
INTSTA
PEIF
T0CKIF
T0IF
INTF
PEIE
T0CKIE
T0IE
INTE
0000 0000
16h, Bank 1
PIR1
RBIF
TMR3IF
TMR2IF
TMR1IF
CA2IF
CA1IF
TX1IF
RC1IF
x000 0010
u000 0010
17h, Bank 1
PIE1
RBIE
TMR3IE
TMR2IE
TMR1IE
CA2IE
CA1IE
TX1IE
RC1IE
0000 0000
16h, Bank 3
TCON1
CA2ED1
CA2ED0
CA1ED1
CA1ED0
T16
TMR3CS
TMR2CS
TMR1CS
0000 0000
17h, Bank 3
TCON2
CA2OVF CA1OVF
PWM2ON
PWM1ON
CA1/PR3
TMR3ON
TMR2ON
TMR1ON 0000 0000 0000 0000
Legend:
x
= unknown, u = unchanged, - = unimplemented, read as ’0’, q = value depends on condition. Shaded cells are not used by PORTB.
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