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參數(shù)資料
| 型號： | PCM1870RHFT |
| 英文描述： | 16-Bit Low-Power Stereo Audio ADC With Microphone Bias and Microphone Amplifier |
| 中文描述： | 16位低功耗立體聲音頻ADC，具有麥克風(fēng)偏置和麥克風(fēng)放大器 |
| 文件頁數(shù)： | 31/49頁 |
| 文件大?。?/td> | 648K |
| 代理商： | PCM1870RHFT |
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www.ti.com
PCM1870
SLAS544–MAY 2007
MSR[2:0]: System Clock Dividing Rate Selection in Master Mode (Register 70)
Default value: 000
These bits are used to set the dividing rate of the input system clock. See
Table 8
for details.
Table 8. System Clock Frequency for Common Audio Clock
REGISTER SETTING
MSR[2:0]
010
011
100
101
110
111
010
100
110
010
011
100
101
110
111
011
101
111
010
011
100
101
110
111
010
011
100
101
110
111
SYSTEM CLOCK
SCK (MHz)
ADC SAMPLING RATE
ADC f
S
(kHz)
DAC SAMPLING RATE
DAC f
S
(kHz)
BIT CLOCK
BCK (f
S
)
NPR[5:0]
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
00 0000
24 (SCK/256)
16 (SCK/384)
12 (SCK/512)
8 (SCK/768)
6 (SCK/1024)
4 (SCK/1536)
32 (SCK/256)
16 (SCK/512)
8 (SCK/1024)
48 (SCK/256)
32 (SCK/384)
24 (SCK/512)
16 (SCK/768)
12 (SCK/1024)
8 (SCK/1536)
48 (SCK/384)
24 (SCK/768)
12 (SCK/1536)
22.05 (SCK/256)
14.7 (SCK/384)
11.025 (SCK/512)
7.35 (SCK/768)
5.5125 (SCK/1024)
3.675 (SCK/1536)
44.1 (SCK/256)
29.4 (SCK/384)
22.05 (SCK/512)
14.7 (SCK/768)
11.025 (SCK/1024)
7.35 (SCK/1536)
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
64
6.144
8.192
12.288
18.432
5.6448
11.2896
NOTE: Other settings are reserved.
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