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參數(shù)資料
| 型號(hào)： | P9S12XEP100J1CALR |
| 廠商： | 飛思卡爾半導(dǎo)體(中國(guó))有限公司 |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數(shù)： | 255/1036頁 |
| 文件大?。?/td> | 3356K |
| 代理商： | P9S12XEP100J1CALR |
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Chapter 5 External Bus Interface (S12XEBIV4)
MC9S12XE-Family Reference Manual Rev. 1.07
Freescale Semiconductor
255
5.4.5.2
Emulation Modes and Special Test Mode
In emulation modes and special test mode, the external signals LSTRB, RW, and ADDR0 indicate the
access type (read/write), data size and alignment of an external bus access. Misaligned accesses to the
internal RAM and misaligned XGATE PRR accesses in emulation modes are the only type of access that
are able to produce LSTRB = ADDR0 = 1. This is summarized in
Table 5-19
.
Table 5-18. Access in Normal Expanded Mode
Access
RE WE UDS LDS
DATA[15:8]
DATA[7:0]
I/O data(addr) I/O data(addr)
Word write of data on DATA[15:0] at an even and even+1 address
1
0
0
0
Out data(even) Out
data(odd)
Byte write of data on DATA[7:0] at an odd address
1
0
1
0
In
x
Out
data(odd)
Byte write of data on DATA[15:8] at an even address
1
0
0
1
Out data(even)
In
x
Word read of data on DATA[15:0] at an even and even+1 address
0
1
0
0
In
data(even)
In
data(odd)
Byte read of data on DATA[7:0] at an odd address
0
1
1
0
In
x
In
data(odd)
Byte read of data on DATA[15:8] at an even address
0
1
0
1
In
data(even)
In
x
Indicates No Access
1
1
1
1
In
x
In
x
Unimplemented
1
1
1
0
In
x
In
x
1
1
0
1
In
x
In
x
Table 5-19. Access in Emulation Modes and Special Test Mode
Access
RW
LSTRB ADDR0
DATA[15:8]
DATA[7:0]
I/O
data(addr)
I/O
data(addr)
Word write of data on DATA[15:0] at an even and even+1
address
0
0
0
Out
data(even)
Out
data(odd)
Byte write of data on DATA[7:0] at an odd address
0
0
1
In
x
Out
data(odd)
Byte write of data on DATA[15:8] at an even address
0
1
0
Out
data(odd)
In
x
Word write at an odd and odd+1 internal RAM address
(misaligned — only in emulation modes)
0
1
1
Out data(odd+1) Out
data(odd)
Word read of data on DATA[15:0] at an even and even+1
address
1
0
0
In
data(even)
In
data(even+1)
Byte read of data on DATA[7:0] at an odd address
1
0
1
In
x
In
data(odd)
Byte read of data on DATA[15:8] at an even address
1
1
0
In
data(even)
In
x
Word read at an odd and odd+1 internal RAM address
(misaligned - only in emulation modes)
1
1
1
In
data(odd+1)
In
data(odd)
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