- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄383732 > P312XDP512F0MPVR (飛思卡爾半導(dǎo)體(中國(guó))有限公司) Covers, S12XD, S12XB & S12XA Families PDF資料下載
參數(shù)資料
| 型號(hào)： | P312XDP512F0MPVR |
| 廠商： | 飛思卡爾半導(dǎo)體(中國(guó))有限公司 |
| 英文描述： | Covers, S12XD, S12XB & S12XA Families |
| 中文描述： | 封面，S12XD，S12XB |
| 文件頁(yè)數(shù)： | 800/1350頁(yè) |
| 文件大?。?/td> | 3951K |
| 代理商： | P312XDP512F0MPVR |
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Chapter 21 External Bus Interface (S12XEBIV2)
MC9S12XDP512 Data Sheet, Rev. 2.17
800
Freescale Semiconductor
21.4.5.2
Emulation Modes and Special Test Mode
In emulation modes and special test mode, the external signals LSTRB, R/W, and ADDR0 indicate the
access type (read/write), data size and alignment of an external bus access. Misaligned accesses to the
internal RAM and misaligned XGATE PRR accesses in emulation modes are the only type of access that
are able to produce LSTRB = ADDR0 = 1. This is summarized in
Table 21-18
.
Table 21-17. Access in Normal Expanded Mode
Access
RE WE UDS LDS
DATA[15:8]
DATA[7:0]
I/O data(addr) I/O data(addr)
Word write of data on DATA[15:0] at an even and even+1 address
Byte write of data on DATA[7:0] at an odd address
Byte write of data on DATA[15:8] at an even address
Word read of data on DATA[15:0] at an even and even+1 address
Byte read of data on DATA[7:0] at an odd address
Byte read of data on DATA[15:8] at an even address
Indicates No Access
Unimplemented
1
1
1
0
0
0
1
1
1
0
0
0
1
1
1
1
1
1
0
1
0
0
1
0
1
1
0
0
0
1
0
0
1
1
0
1
Out data(even) Out
In
x
Out data(even)
In
data(even)
In
x
In
data(even)
In
x
In
x
In
x
data(odd)
data(odd)
x
data(odd)
data(odd)
x
x
x
x
Out
In
In
In
In
In
In
In
Table 21-18. Access in Emulation Modes and Special Test Mode
Access
R/W LSTRB ADDR0
DATA[15:8]
DATA[7:0]
I/O
data(addr)
I/O
data(addr)
Word write of data on DATA[15:0] at an even and even+1
address
Byte write of data on DATA[7:0] at an odd address
Byte write of data on DATA[15:8] at an even address
Word write at an odd and odd+1 internal RAM address
(misaligned — only in emulation modes)
Word read of data on DATA[15:0] at an even and even+1
address
Byte read of data on DATA[7:0] at an odd address
Byte read of data on DATA[15:8] at an even address
Word read at an odd and odd+1 internal RAM address
(misaligned - only in emulation modes)
0
0
0
Out
data(even)
Out
data(odd)
0
0
0
0
1
1
1
0
1
In
Out
Out data(odd+1) Out
x
Out
In
data(odd)
x
data(odd)
data(odd)
1
0
0
In
data(even)
In
data(even+1)
1
1
1
0
1
1
1
0
1
In
In
In
x
In
In
In
data(odd)
x
data(odd)
data(even)
data(odd+1)
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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