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參數(shù)資料
| 型號： | P2V28S20DTP-7 |
| 廠商： | Vanguard International Semiconductor Corporation |
| 英文描述： | 128Mb SDRAM Specification |
| 中文描述： | 128Mb的SDRAM內(nèi)存規(guī)格 |
| 文件頁數(shù)： | 23/51頁 |
| 文件大?。?/td> | 652K |
| 代理商： | P2V28S20DTP-7 |
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128Mb Synchronous DRAM
JULY.2000
Rev.2.2
P2V28S20ATP-7,-75,-8 (4-BANK x 8,388,608-WORD x 4-BIT)
P2V28S30ATP-7,-75,-8 (4-BANK x 4,194,304-WORD x 8-BIT)
P2V28S40ATP-7,-75,-8 (4-BANK x 2,097,152-WORD x 16-BIT)
Page-22
[Read Interrupted by Burst Terminate]
Similarly to the precharge, a burst terminate command can inter-
rupt the burst read operation and disable the data output. The
terminated bank remains active.
Read Interrupted by Terminate (BL=4)
READ to TBST interval is minimum 1 CLK. A TBST command to
output disable latency is equivalent to the /CAS Latency.
CLK
CL=3
Command
DQ
READ
TBST
Q0
Q1
Q2
Command
DQ
READ
Q0
CL=2
Command
DQ
READ
Q0
Q1
Q2
Command
DQ
READ
Q0
Command
DQ
READ
Q0
Q1
Command
DQ
READ
Q0
Q1
TBST
TBST
TBST
TBST
TBST
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| P2V28S30ATP-7 | 128Mb SDRAM Specification |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| P2V28S30ATP-7 | 制造商:VML 制造商全稱:VML 功能描述:128Mb SDRAM Specification |
| P2V28S30ATP-75 | 制造商:VML 制造商全稱:VML 功能描述:128Mb SDRAM Specification |
| P2V28S30ATP-8 | 制造商:VML 制造商全稱:VML 功能描述:128Mb SDRAM Specification |
| P2V28S40ATP-7 | 制造商:VML 制造商全稱:VML 功能描述:128Mb SDRAM Specification |
| P2V28S40ATP-75 | 制造商:VML 制造商全稱:VML 功能描述:128Mb SDRAM Specification |
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